maxplusii图形输入方式

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1、第1章MAX+PLUSII图形输入方式MAX+plusII设计流程图形或HDL编辑器编译网表提取、数据库建立、逻辑综合、逻辑分割、适配延时网表提取、编程文件汇编编程器设计输入综合或编辑适配器件下载仿真半加器只求本位和，不考虑低位的进位。实现半加操作的电路叫做半加器。C=ABA、B为两个加数C为向高位的进位S为半加和状态表ABC0000101011S010110被加数、加数以及低位的进位三者相加称为“全加”，实现全加操作的电路叫做全加器。Ci-1：来自低位的进位Ci：向高位的进位全加器半加器半加器AiBiCi-1CiSiSAi

2、BiSCi-1>1AiBiCi-1Si00000001101110001111010010111011状态表Ci01111000第1章MAX+PLUSII图形输入方式1.1基本设计步骤步骤1：为本项工程设计建立文件夹注意：文件夹名不能用中文，且不可带空格。以1位全加器设计为例讲述MAX+PLUSII图形输入方式设计流程文件夹名取为adder注意，文件夹名不可用中文为设计全加器新建一个文件夹作工作库步骤1：为本项工程设计建立文件夹步骤2：打开MAX+PLUSII，输入设计项目和存盘进入MAX+plusII，建立一个新的设计文件

3、使用原理图输入方法设计必须选择打开原理图编辑器新建一个设计文件图形编辑器窗口简介元件输入对话框首先在这里用鼠标右键产生此窗，并选择“EnterSymbol”输入一个元件也可在这里输入元件名，如2输入与门AND2，输出引脚：OUTPUT然后用鼠标双击这基本硬件库这是基本硬件库中的各种逻辑元件将所需元件全部调入原理图编辑窗口连接好的原理图输出引脚OUTPUT输入引脚INPUT将他们连接成半加器连接好原理图并存盘首先点击这里文件名取为：h_adder.gdf注意：要存在自己建立的文件夹中再点击这里注意选择存储位置步骤3：将设计项目

4、设置成工程文件(PROJECT)将当前设计文件设置成工程文件首先点击这里然后选择此项，将当前的原理图设计文件设置成工程最后注意此路径指向的改变注意：此路径指向当前的工程步骤4：选择目标器件并编译选择最后实现本项设计的目标器件首先选择这里首先消去这里的勾，以便使所有速度级别的器件都能显示出来如选目标器件型号为EPM7128SLC84-15器件系列选择窗选择MAX7000S系列对工程文件进行编译、综合和适配等操作选择编译器编译窗口完成编译步骤5：时序仿真(1)建立波形文件首先选择（File—>New）为仿真测试新建一个文件选择波

5、形编辑器文件(2)输入信号节点从SNF文件中输入设计文件的信号节点从SNF文件中输入设计文件的信号节点点击“LIST”SNF文件中的信号节点列出并选择需要观察的信号节点用此键选择左窗中需要的信号进入右窗最后点击“OK”(2)输入信号节点图4-9列出并选择需要观察的信号节点(3)设置波形参量在Options菜单中消去网格对齐SnaptoGrid的选择(消去对勾)消去这里的勾，以便方便设置输入电平(4)设定仿真时间选择ENDTIME调整仿真时间区域选择60微秒比较合适(5)加上输入信号为输入信号设定必要的测试电平或数据(6)波形

6、文件存盘保存仿真波形文件用此键改变仿真区域坐标到合适位置点击‘1’，使拖黑的电平为高电平文件名和图形文件名相同存储路径也相同(7)运行仿真器选择仿真器运行仿真器(8)观察分析半加器仿真波形半加器h_adder.gdf的仿真波形为了精确测量半加器输入与输出波形间的延时量，可打开时序分析器选择时序分析器输入输出时间延迟(9)打开延时时序分析窗(10)包装元件入库选择菜单“File”→“Open”，在“Open”对话框中选择原理图编辑文件选项“GraphicEditorFiles”，然后选择h_adder.gdf，重新打开半加器设

7、计文件，然后选择如图中“File”菜单的“CreateDefaultSymbol”项，将当前文件变成了一个包装好的单一元件(Symbol)，并被放置在工程路径指定的目录中以备后用。步骤6：管脚分配单击此项单击后出现下图步骤6：管脚分配步骤6：管脚分配选择此项单击Layout选项，选择DeviceView选项可观察MAX+PLUSII的默认管脚分配情况步骤6：管脚分配选择此项选择后，即可进入手动分配引脚状态步骤6：管脚分配利用鼠标左键选定引脚鼠标左键选定要分配的管脚，拖动鼠标到要放置的位置，松开鼠标左键，即可完成一个引脚的手动

8、分配，依次放置所有引脚，即可完成引脚的手动分配。再编译一次，将引脚信息编译进去选择编程器，准备将设计好的半加器文件下载到目器件中去编程窗口步骤7：编程下载(1)下载方式设定。设置编程下载方式在编程窗打开的情况下选择下载方式设置选择此项下载方式步骤7：编程下载(1)下载方式设定。图4-18设