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时间:2018-11-27
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1、数字逻辑电子技术实验指导与设计第三章附录集成逻辑门电路新、旧图形符号对照名称新国标图形符号旧图形符号逻辑表达式与门Y=ABC或门Y=A+B+C非门Y=A与非门Y=ABC或非门Y=A+B+C与或非门Y=AB+CD异或门Y=AB+AB13数字逻辑电子技术实验指导与设计集成触发器新、旧图形符号对照名称新国标图形符号旧图形符号触发方式由与非门构成的基本RS触发器无时钟输入,触发器状态直接由S和R的电平控制由或非门构成的基本RS触发器TTL边沿型JK触发器CP脉冲下降沿TTL边沿型D触发器CP脉冲上升沿CMOS边沿型JK触发器CP脉冲上升沿CMOS边沿型D触发器CP脉冲上升沿13数字逻辑电子技术实验指
2、导与设计部分集成电路引脚排列一、74LS系列74LS00四2输入与非门74LS86四2输入异或门74LS03四2输入OC与非门74LS32四2输入或门74LS04六反相器74LS08四2输入与门74LS20双4输入与非门74LS5413数字逻辑电子技术实验指导与设计74LS7474LS0274LS9074LS11274LS12574LS13874LS15174LS15313数字逻辑电子技术实验指导与设计74LS17574LS19274LS19374LS194DAC0832ADC0809uA741运算放大器555时基电路13数字逻辑电子技术实验指导与设计74LS16174LS14874LS30
3、74LS244二、CC4000系列CC4001四2输入或非门CC4011四2输入与非门13数字逻辑电子技术实验指导与设计CC4012双4输入与非门CC4030四异或门CC4071四2输入或门CC4081四2输入与门CC4069六反相器CC40106六施密特触发器CC4027CC402813数字逻辑电子技术实验指导与设计CC4013CC4042CC4068CC4020CC4017CC4022CC4082CC408513数字逻辑电子技术实验指导与设计CC4086CC4093施密特触发器双时钟BCD可预置数CC14528(CC4098)十进制同步加/减计数器CC402413数字逻辑电子技术实验指导
4、与设计CC7107CC40194CC1443313数字逻辑电子技术实验指导与设计三、CC4500系列CC4511CC4514CC14516CC4518CC4553CC14512CC1453913数字逻辑电子技术实验指导与设计MC1413(ULN2003)CC3130七路NPN达林顿列阵MC1403CC4068ISP1016MACH-64/3213数字逻辑电子技术实验指导与设计13
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