计数器的原理

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1、计数器的原理计数器是数字电路中广泛使用的逻辑部件，是时序逻辑电路中最重要的逻辑部件之一。计数器除用于对输入脉冲的个数进行计数外，还可以用于分频、定时、产生节拍脉冲等。计数器按计数脉冲的作用方式分类，有同步计数器和异步计数器；按功能分类，有加法计数器、减法计数器和既具有加法又有减法的可逆计数器；按计数进制的不同，又可分为二进制计数器、十进制计数器和任意进制计数器。一、计数器的工作原理1、二进制计数器（1）异步二进制加法计数器图1所示为用JK触发器组成的4位异步二进制加法计数器逻辑图。图中4个触发器F0~F3均处于计数工作状态。计数脉冲从最低位触发器F0的CP端输入，

2、每输入一个计数脉冲，F0的状态改变一次。低位触发器的Q端与高位触发器的CP端相连。每当低位触发器的状态由1变0时，即输出一负跳变脉冲时，高位触发器翻转。各触发器置0端RD并联，作为清0端，清0后，使触发器初态为0000。当第一个计数脉冲输入后，脉冲后沿使F0的Q0由0变1，F1、F2、F3均保持0态，计数器的状态为0001；当图14位异步二进制加法计数器第二个计数脉冲输入后，Q0由1变为0，但Q0的这个负跳变加至F1的CP端，使Q1由0变为1，而此时F3、F2仍保持0状态，计数器的状态为0010。依此类推，对于F0来说，每来一个计数脉冲后沿，Q0的状态就改变，而对

3、于F1、F2、F3来说，则要看前一位输出端Q是否从1跳到0，即后沿到来时，其输出端的状态才改变，否则Q1、Q2、Q3端的状态同前一个状态一样。这样在第15个计数脉冲输入后，计数器的状态为1111，第16个计数脉冲输入，计数器恢复为0000。由上述分析可知，一个4位二进制加法计数器有24=16种状态，每经过十六个计数脉冲，计数器的状态就循环一次。通常把计数器的状态数称之为计数器的进制数（或称计数器的模），因此，4位二进制计数器也可称之为1位十六进制（模16）计数器。表1所示为4位二进制加法计数器的状态表。计数脉冲和各触发器输出端的波形如图2所示。图2直观地反映出最低

4、位触发器Q0在CP脉冲后沿触发，而各高位触发器又是在相邻低位触发器输出波形的后沿触发。从图中还可以看出每经过一级触发器，脉冲波形的周期就增加1倍，即频率降低一半，则从Q0引出的脉冲对计数脉冲为两（21）分频，从Q1引出的脉冲对计数脉冲为四（22）分频，依此类推，从n位触发器输出端Qn引出的脉冲对计数脉冲为2n分频，因此，计数器可以用于分频电路。对异步二进制加法计数器的特点归纳如下：1）计数器由若干个计数型触发器所组成，各触发器之间的连接方式取决于触发器的类型。如由脉冲下降沿触发的触发器组成，则进位信号从Q端引出，如用脉冲上升沿触发的触发器构成计数器，则进位信号从端

5、引出。2）n个触发器具有2n个状态，其计数容量（即能记住的最大二进制数）为2n-1。表14位异步二进制加法计数器状态表计数脉冲数四位触发器状态对应的十进制数Q3Q2Q1Q0012345678910111213141516000000010010001101000101011001111000100110101011110011011110111100000123456789101112131415163）图1所示的二进制计数器的CP脉冲只加到最低位触发器，其他各位触发器则由相邻低位触发器的进位脉冲来触发，因此其状态的变换有先有后，是异步的，其计数的速度难以提高。图

6、24位二进制加法计数器工作波形（2）同步二进制加法计数器同步二进制计数器是用计数脉冲同时去触发计数器中各触发器的CP端，使各触发器的状态变换与计数脉冲同步，不存在各触发器之间的进位传输延迟，因而计数速度高。同步二进制加法计数器与异步二进制加法计数器的状态表和工作波形都相同。如果计数器是由脉冲下降沿触发的四个JK触发器组成，根据表1可得出各位触发器的J、K端的逻辑关系式。1）第一位触发器F0，每来一个计数脉冲就翻转一次，故J0=K0=1；2）第二位触发器F1，在Q0=1时，再来一个计数脉冲才翻转，故J1=K1=Q0；3）第三位触发器F2，在Q1=Q0=1时，再来一个

7、计数脉冲才翻转，故J2=K2=Q1Q0；4）第四位触发器F3，在Q2=Q1=Q0=1时，再来一个计数脉冲才翻转，故J3=K3=Q2Q1Q0。由上述逻辑关系式可得出图3所示的4位同步二进制加法计数器的逻辑图。现分析其工作原理：设触发器初态为0000。在第一个计数脉冲后沿到达时，F0翻转为1态，由于此时F1~F3的J、K端均为0，故不翻转，计数器输出为0001；在第二个计数脉冲到来前，由于F1的J1=K1=Q0=1，故在第二个计数脉冲后沿到达时，F0由1翻转为0，F1由0翻转为1，而此时F2、F3的J、K均为0，不翻转，计数器输出为0010；依此类推，当第十五个计数脉

8、冲后沿到达