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时间:2018-11-19
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1、平台FPGA架构用于复杂嵌入式系统
2、第1回收工程)成本、功率、尺寸、性能、灵活性、原型制造时间、产品上市时间、产品在市场生存时间、可维护性、可重配置能力、工程资源、开发和设计周期、工具、硬件/软件划分,以及其他许多因素。 Virtex-IIProTM平台FPGA产品基于高性能的Virtex-IITM结构,为嵌入式系统设计提供了一个极灵活的解决方案。利用Virtex-IIProTM器件,嵌入式系统设计人员可以在单片器件内集成范围广泛的硬和软IP核心,其中的硬件和固件具有可升级能力,从而可延长产品的在市场生存时间。Virtex-
3、II结构的可编程能力降低了系统开发时间并使单个平台FPGA解决方案可适用于多种应用。Virtex-IIProTMFPGA使系统设计人员可在整个开发周期中对系统进行优化,同时还为硬件和软件设计任务折衷提供了无与伦比的协同设计灵活性。硬件/软件系统划分允许设计人员可以控制以效率最高的方式实现所需要的功能。 Virtex-IIProTM平台FPGA产品提供了一个可以满足多种应用的处理、DSP和连接功能要求的平台,这些应用包括光学网络系统、千兆位路由器、无线蜂巢式基站、调制解调器阵列、专业视频广播系统、测试和测量设备、生物医疗系统、
4、工业控制器,以及其他许多应用。下面我们重点列出了Virtex-IIProTM平台FPGA的主要特性和功能。RocketI/OTM收发器 Virtex-IIProTM器件提供了高达16个千兆位并串和串并收发器,可以支持不同的高速串行标准,如GigabitEther、FiberChannel、Infiniband、SerialATA、RapidIO、3GIO、Aurora、和XAUI。其通道绑定功能可以结合多个通道提供高于3.125Gb/s的数据传输速率。RocketI/OTM收发器支持物理媒体附加子层(串行化器、并串转换器、时
5、钟和数据恢复、发送/接收缓冲器)和物理编码子层(8B/10B编码器/解码器和弹性缓冲器)。Pomersion架构完成的。IP-Immersion架构允许硬核心扩散分布到平台FPGA结构中的任意位置,同时还可保持与周围逻辑阵列间的无与伦比的连接能力。利用处理器局部总线(PLB)和采用CoreConnect互连总线片上总线架构的外设总线,处理器可以控制和管理多种外设资源。运行在300+MHz时钟下,能够提供420+DhrystoneMIPS性能的Poouseg(this)">全局时钟 高频率设计需要低畸变的高级时钟分配。在多数大
6、密度设计中通常需要大量全局时钟。所有的Virtex-IIProTM器件都包含16个全局时钟缓冲器,支持16个全局时钟区域。这些时钟域支持进行更高水平的逻辑集成,并免除了进行复杂的时钟树分析的需要。16个时钟缓冲器还是“无毛刺”同步2:1复用器。这些复用器可以在任意时间在两个异步(或同步)时钟间进行切换。数字时钟管理器(DCM) Virtex-IIProTM器件提供多达8个数字时钟管理器(DCM)。每一个DCM都支持零延迟时钟缓冲、精确相位移动和频率合成控制。DCM还支持对其输出时钟进行90°、180°和270°的相移。异常灵
7、活的频率合成可提供输入时钟频率分数倍数或整数倍数的时钟输出频率。500)this.style.ouseg(this)">(点击小图看大图)片上存储器(OCM)控制器 OCM控制器在FPGA中的块RAM和嵌入式PoGenerator工具可利用CoreConnect互连总结架构自动集成PoeryController、FPGA、PLD以及PortControllerMAC模块可以利用Xilinx或其联盟IP合作伙伴所提供的软IP核心代替的数字器件。 Virtex-IIProTM的可编程特性使嵌入式系统设计人员可在整个开发周期中对
8、系统进行优化,并为硬件和软件设计折衷提供了无与伦比的协同设计灵活性。软件/硬件划分可提供效率最高的解决方案。以软件方式完成硬件任务成本较低但速度慢。用硬件来完成软件任务速度快但成本高且效率也不高。Virtex-II平台FPGA器件可以在软件和硬件实施间实现实用的平衡,同时还可提供基于设计规范和要求的最佳解决方案。 当今的许多通信标准和协议还不成熟,并仍处于持续的演化进行中。在很多情况下ASIC和ASSP解决方案并不适用,因为它们不能随着标准的演化而改变。FPGA是这种情况下的理想选择,因为他们有可配置的结构,可以容易地实现、
9、重新配置和升级(甚至可通过因特网)新的标准和协议。通信系统(或任何具有多种协议的系统)中存储的不同协议也要求内置协议变换功能。Virtex-IIProTMFPGA可以非常好地完成此类重要任务。 更少的电路板器件也意味着需要更小的电路板空间,因此,系统成本中又可节约每层每平方
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