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1、13EDA工具使用方法 及常用电路设计方法2本单元介绍基于QuartusII软件的EDA设计流程软件版本：QuartusII9.x31.基于QuartusII软件的EDA设计流程1创建工程2编辑和输入设计文件3编译4仿真测试5引脚锁定6下载7硬件调试设计步骤41.基于QuartusII软件的EDA设计流程例：全加器设计步骤moduleadder(a,b,cin,s,co);inputa,b,cin;outputs,co;assigns=a^b^cin;assignco=a&b+a&cin+b&cin;endmodule52.常用组合电路的设计方法组合电路特点
2、：任意时刻的输出仅仅决定于该时刻的输入，与电路原来的状态无关。电路中无存储器、无反馈结构；无记忆功能。常用的组合电路：编码器译码器数据选择器加法器数值比较器奇偶校验器2.常用组合电路的设计方法6简单的组合关系可用门原语或assign语句或always语句实现；复杂的最好用always语句实现。用verilog语句设计组合电路比较简单，常用语句：assign语句、门原语调用、always语句2.常用组合电路的设计方法例1：已知逻辑图，写出.v代码例1：已知逻辑式写出.v代码用assign语句或always语句全加器常见的四种已知情况：已知逻辑图；已知逻辑式；已
3、知真值表；已知逻辑功能。2.常用组合电路的设计方法例2：已知逻辑图，写出.v代码适合用门原语全加器92.常用组合电路的设计方法例3：已知真值表，写出.V代码。用always语句（配合case语句或if语句）编码器102.常用组合电路的设计方法例4：已知74LS138译码器的逻辑功能，写出.v代码用always语句（用if语句描述片选功能，用case语句描述译码功能）74LS138A0A1A2S1S2S32.常用组合电路的设计方法用always语句设计组合电路时要注意：敏感条件为电平变化用阻塞赋值若用if语句或case语句，条件要完整，否则会综合出寄存器。2.
4、常用组合电路的设计方法例：用if语句实现3选1数据选择器。moduleMUX31(a,b,c,s1,s0,y);inputa,b,c,s1,s0;outputregy;always@(a,b,c,s1,s0)if({s1,s0}==2'b00)y=a;elseif({s1,s0}==2'b01)y=b;elseif({s1,s0}==2'b10)y=c;elsey=1'b0;endmodule132.常用组合电路的设计方法加elsealways@(a,b)if(sel)Q=a;elseQ=b;always@(a,b)Q=b;if(sel)Q=a;使if语句条
5、件完整的两种方法：2.在if之前设初值2.常用组合电路的设计方法用case语句实现3选1数据选择器：moduleMUX31(a,b,c,s1,s0,y);inputa,b,c,s1,s0;outputregy;always@(a,b,c,s1,s0)begincase({s1,s0})2'b00:y=a;2'b01:y=b;2'b10:y=c;default:y=1'b0;endcaseendendmodule152.常用组合电路的设计方法3.case所有情况case语句使条件完整的三种方法：1.加defaultcase({s1,s0})2'b00:y=a;
6、2'b01:y=b;2'b10:y=c;default:y=1'b0;endcasecase({s1,s0})2'b00:y=a;2'b01:y=b;2'b10:y=c;2’b11:y=0;endcase2.在case前设初值y=1'b0;case({s1,s0})2'b00:y=a;2'b01:y=b;2'b10:y=c;endcase2.常用组合电路的设计方法编码器设计always@(I7,I6,I5,I4,I3,I2,I1,I0)case({I7,I6,I5,I4,I3,I2,I1})7’b1000000:{Y2,Y1,Y0}=3’b111;7’b01
7、00000:{Y2,Y1,Y0}=3’b110;7’b0010000:{Y2,Y1,Y0}=3’b101;……7’b0000001:{Y2,Y1,Y0}=3’b001;default:{Y2,Y1,Y0}=3’b000;endcaseencoderI7I6I5I4I3I2I1I0Y2Y1Y0普通编码器：任意时刻有且只有一个输入有效关键语句用case语句例8/3线编码器172.常用组合电路的设计方法always@(*)if(I7){Y2,Y1,Y0}=3’b111;elseif(I6){Y2,Y1,Y0}=3’b110;elseif(I5)……..优先编码器：
8、可以多个输入有效，输出优先级高的信号编码if语句能体
