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1、利用DVI实现双屏幕超宽图像的显示.freelage、intel、paq、ibm、hp、nec、fujitsu等公司共同组成的数字显示工作组ddage公司的panallink接口技术,是一种与显示工艺无关的高速显示数字接口,采用最小化传输差分信号tmds作为基本电气连接。dvi标准一经推出就立即得到了响应,各图形芯片厂商纷纷推出了支持dvi标准的芯片组,viesung公司也相继推出了采用dvi标准接口的crt显示器和lcd显示器。在新近上市的一些lcd和dlp标准中对接口的方式、电气指标、时钟方式、编码方式、传输方式、数据格式等都做了严格的定义和规范。其主要特点包括:从产生到显示
2、的无损失数字连接;与显示工艺无关;通过edid和ddc2b热插检测的即插即用;兼容数字、模拟接口等。2dvi图像传输协议dvi接口传送的数据信号包括了一些象素、同步信息以及控制信息。分3个通道输出,同时还有一个通道用来传送使发送和发送端同步的时钟信号。每个通道中数据以差分信号方式传输,因此每一个通道需要2根传输线。具体连接方式如图1所示。数据信号和控制信号通过de信号来控制。de为高时,传输象素数据,为低时传输控制信号,要求de为低至少128个时钟周期,为高最大不超过8191个时钟周期。在de为高期间,控制信号将保持;而de为低时,角素数据被忽略。在tmds每线对传输的串行信号格
3、式为每个时钟周期传送10bit,其中有效数据荷载为8bit,剩下两位分别为编码模式位和直流均衡位。dvi规范规定的数字图像分辨率范围如图2。对于75hz的crt来说,单连接最大为sxga1280×1024,双连接最大为qxga2048×1536。所以单连接选择1024×768比较合适。但是单连接对于60hz的lcd显示来说,最大上限为uxga1600×1200、时钟最大上限为165mhz。色彩深度限制:因为dvi的图像传输默认为24bit,要得到更丰富的色彩,必须使用另一通道来扩展。因此在双通道应用色彩深度自然限制在24bit,控制数据为6bit。3图像拼接无论是对单连接或双连接
4、,象素的显示次序都只考虑逐行显示的计算机通用显示器,按奇偶象素进行间隔发送。奇偶按每行内的相邻角素来分。对双连接为link#0发送"奇象素",link#1发送"偶象素";对单连接主要是收发芯片上采用两套象不比数据接口,即:oddrgb、evenrgb。要驱动两个显示器,必须实现两对hsync、vsync控制信号,对双连接和单连接均有这个总是。虽然dvi标准中控制信号ctl1以后的信号现在都是保留的,乍一看,似乎可以符合应用,将一对控制信号ctln和ctln+1复用到hsync、vsync两个控制信号上就可以了。但实际上,这样必须拆解dvi标准的口收发芯片,而且其时钟很高,很难用可
5、编程器件来实现。因此在复用hsync、vsync两个控制信号的复用选择级别上,如果选择在tmds传输线对上,虽然有硬件实现逻辑简单的优点,但却既找不到现在的芯片,又无法实现热拔识别功能。经过比较选择在信号接收后做两路驱动处理。如此频率也不是很高,而且全部是数字信号,可以灵活地用epld实现,同时还可以实现热插拔识别总是,绕过双连接时单连接禁止功能(双连接系统虽然可以在单、双连接中灵活切换。但是如果其驱动的是单连接监视器,另外一个连接被禁止);实现双连接驱动时,单连接和双连接之间自由切换。4连接方案4.1发送和接受oem芯片硬件siliconimage公司是dvi的发起人之一,有种
6、类齐全的dvi接口芯片,其中发送芯片为sii160ct100,接收芯片为sii16bct100。所有的发送和接收芯片都有两套象素端口,这样不仅可以在tmds通道级实现双屏幕显示,同时还可以在象素级实现双屏幕显示。大致的芯片功能模块组成如图3所示。输入信号包括象素输入信号die23:0和dio23:0、时钟信号idck、数据选择信号de、同步信号hsync、vsync。此外还有两个配置信号,edge为时钟沿选择信号,pixs为每时钟单象素、双象素选择信号。一个电压摆率调节信号控制端,远端显示应用推荐用510Ω的电阻连到avcc。在实际应用中,注意pixs信号必须拉高,用于实现每个时
7、钟周期两个象素应用。4.2分辨率限制目前只有单连接的dvi收发芯片,可以实现的复用分辨率为800×660。因为单通道对于60hz的lcd显示器来说,最大分辨率为1600×1200,就通道传输率而言可以做得更高,达到1024×768。考虑到实际应用中的简便性和通用性,牺牲一半的显示分辨率是值得的。4.2两种连接方式对于实际的连接方式存在两种方案:单连接和双连接。两种方案的实现上有相近实现结构,区别在于收发芯片不同,同时造成显示分辨率也存在区别。目前双连接仅仅是协议支持,还没有货架产
