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1、74HC595引脚说明 符号引脚描述 Q0…Q78位并行数据输出，其中Q0为第15脚 GND第8脚地 Q7’第9脚串行数据输出 MR第10脚主复位（低电平） SHCP第11脚移位寄存器时钟输入 STCP第12脚存储寄存器时钟输入 OE第13脚输出有效（低电平） DS第14脚串行数据输入VCC第16脚电源功能表 输入输出功能SHCPSTCPOEMRDSQ7’Qn××L↓×LNCMR为低电平时仅仅影响移位寄存器×↑LL×LL空移位寄存器到输出寄存器××HL×LZ清空移位寄存器，并行输出为高阻状态↑×LHHQ6NC逻辑高电平移入移位寄存器状态0，包含所有的移位寄存器状态移
2、入×↑LH×NCQn’移位寄存器的内容到达保持寄存器并从并口输出↑↑LH×Q6’Qn’移位寄存器内容移入，先前的移位寄存器的内容到达保持寄存器并出74HC13820currencydeposit,weprescribeapassonaregularbasis,qilucardaccountonaregularbasis),certificatebondsandsavingsbonds(electronic);3.notdrawnonabanksavingscertificate,certificatebondsapplyformortgageloans,acceptingonlythe
3、lender74HC138是一款高速CMOS器件，74HC138引脚兼容低功耗肖特基TTL（LSTTL）系列。 74HC138译码器可接受3位二进制加权地址输入（A0,A1和A2），并当使能时，提供8个互斥的低有效输出（Y0至Y7）。74HC138特有3个使能输入端：两个低有效（E1和E2）和一个高有效（E3）。除非E1和E2置低且E3置高，否则74HC138将保持所有输出为高。利用这种复合使能特性，仅需4片74HC138芯片和1个反相器，即可轻松实现并行扩展，组合成为一个1-32（5线到32线）译码器。任选一个低有效使能输入端作为数据输入，而把其余的使能输入端作为选通端，则74
4、HC138亦可充当一个8输出多路分配器，未使用的使能输入端必须保持绑定在各自合适的高有效或低有效状态。 74HC138与74HC238逻辑功能一致，只不过74HC138为反相输出。编辑本段功能 CD74HC138，CD74HC238和CD74HCT138，CD74HCT238是高速硅栅CMOS解码器，适合内存地址解码或数据路由应用。74HC138作用原理于高性能的存贮译码或要求传输延迟时间短的数据传输系统,在高性能存贮器系统中,用这种译码器可以提高译码系统的效率。将快速赋能电路用于高速存贮器时,译码器的延迟时间和存贮器的赋能时间通常小于存贮器的典型存取时间,这就是说由肖特基钳位的系
5、统译码器所引起的有效系统延迟可以忽略不计。HC138按照三位二进制输入码和赋能输入条件,从8个输出端中译出一个低电平输出。两个低电平有效的赋能输入端和一个高电平有效的赋能输入端减少了扩展所需要的外接门或倒相器,扩展成24线译码器不需外接门;扩展成32线译码器,只需要接一个外接倒相器。在解调器应用中,赋能输入端可用作数据输入端。74HC/HCT0420currencydeposit,weprescribeapassonaregularbasis,qilucardaccountonaregularbasis),certificatebondsandsavingsbonds(electron
6、ic);3.notdrawnonabanksavingscertificate,certificatebondsapplyformortgageloans,acceptingonlythelender该74HC/HCT04是高速的硅栅CMOS器件 并兼容低功耗肖特基的TTL （LSTTL）。他们中指明遵守JEDEC的74hc04没有标准。7A款。74HC/HCT04提供的6个颠倒 缓冲器。 74HC04 74HC04是内含6组相同的反相器。即1A输入高电平，1Y输出低电平 六反相器简要说明 04为六组反相器，共有54/7404、54/74H04、54/74S04、54/7
7、4LS04四种线路结构形 式，其主要电特性的典型值如下： 型号tPLHtPHLPD 5404/740412ns8ns60mW 54H04/74H046ns6.5ns140mW 54S04/74S043ns3ns113mW20currencydeposit,weprescribeapassonaregularbasis,qilucardaccountonaregularbasis),certificatebondsandsavingsb
