数字电子技术总复习2

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1、思考题列出图题3所示电路的真值表。思考题：图题3（a）电路的真值表如表解3（a）所示；图题3（b）电路的真值表如表解2.13（b）所示。表解3（a）表解3（b）CABL110010101001100×高阻BAL2000111×高阻       思考题：电路如图题4所示，已知CMOS门电路的输出电压VOH=4.7V，VOL=0.1V，试计算接口电路的输出电压VO（三极管的集电极电位）。并说明接口参数选择是否合理。图题4 解：当VOH=4.7V时：因IB>IBS，所以三极管饱和：Vo≈0.3V。能够为TTL门提供合适的输入低电平。当VOL=0.1V时：因电

2、压达不到发射结的门坎电压，所以三极管截止：Vo=VCC-RC×4IIH=4.6V(取IIH=50mA)可见，能够为TTL门提供合适的输入高电平。由以上分析知，接口参数选择合理P1573.23根据公式：【教学内容】第三章组合逻辑电路总结主要内容Ø组合逻辑电路的分析方法Ø组合逻辑电路的设计方法Ø五种常用的组合逻辑电路Ø竞争冒险现象具体内容组合逻辑电路的分析方法：写出逻辑式，列出真值表，分析逻辑功能组合逻辑电路的设计方法：逻辑抽象，列出真值表，写出表达式，用门电路实现：化简逻辑式，画出逻辑图用译码器或数据选择器或加法器实现：转换逻辑式形式，与标准形式对比，确

3、定输入输出，画出逻辑图常用的五种组合逻辑电路功能分类特点芯片扩展原理编码器将输入信号编码输出普通编码器任一时刻只能有一个输入有效优先编码器可以多个输入有效，只对优先权高的输入编码输出74LS148P148前级的选通输出端接后级的片选端，将各级的扩展端经编码输出作高位码将输入信号译码输出二进制译码器输入为二进制码74LS138高位地址经译码输出控制各片的片选端译码器可实现组合逻辑二－十进制译码器输入为BCD码BCD－7段显示译码器输入为BCD码，输出为7段显示码7448数据选择器根据地址输入，选择相应的输入数据输出可实现组合逻辑双4选174LS153高位

4、地址经译码输出控制各片的片选端，输出相或加法器完成二进制数的加法可实现组合逻辑串行进位加法器速度慢，电路简单将低位进位输出接高位进位输入并行进位加法器速度快，电路复杂74LS283比较器比较两个二进制数大小CC14585将低位的输出接高位的扩展输入竞争冒险现象：由于输入信号不能同时到达输入端，而在输出端可能产生毛刺的现象。重点掌握1．掌握组合逻辑电路的分析方法2．掌握组合逻辑电路的设计方法3．了解常用组合逻辑电路的内部结构及工作原理。4．掌握常用组合逻辑电路的功能、使用方法（包括扩展连接方法）5．掌握用译码器、数据选择器设计组合电路的方法。6．掌握竞争

5、冒险现象的的概念，掌握判断方法，了解消除方法思考题1．若在编码器中有50个编码对象，则要求输出二进制代码位数为B位。A.5B.6C.10D.502.一个16选一的数据选择器，其地址输入（选择控制输入）端有C个。A.1B.2C.4D.163．四选一数据选择器的数据输出Y与数据输入Xi和地址码Ai之间的逻辑表达式为Y=A。A.B.C.D.4．在下列逻辑电路中，不是组合逻辑电路的有D。A.译码器B.编码器C.全加器D.寄存器5．组合逻辑电路消除竞争冒险的方法有AB。A修改逻辑设计B.在输出端接入滤波电容C.后级加缓冲电路D.屏蔽输入信号的尖峰干扰6．用三线-

6、八线译码器74LS138实现原码输出的8路数据分配器，应ABC。A.=1，=D，=0B.=1，=D，=DC.=1，=0，=DD.=D，=0，=07．以下电路中，加以适当辅助门电路，AB适于实现单输出组合逻辑电路。A.二进制译码器B.数据选择器C.数值比较器D.七段显示译码器8．用四选一数据选择器实现函数Y=，应使A。A.D0=D2=0，D1=D3=1B.D0=D2=1，D1=D3=0C.D0=D1=0，D2=D3=1D.D0=D1=1，D2=D3=09．用三线-八线译码器74LS138和辅助门电路实现逻辑函数Y=，应AB。A.用与非门，Y=B.用与门，

7、Y=C.用或门，Y=D.用或门，Y=答案：1．B2．C3．A4．D5．AB6．ABC7．AB8．A9．AB思考题试判断下列表达式对应的电路是否存在竞争冒险。（1）（2）（3）解：（1）当A=1，C=0时，会产生竞争冒险。（2）当A=C=0时，会产生竞争冒险。（3）不存在竞争冒险思考题．与或非门组成的电路如图所示：F≥1&（1）写出输出函数的表达式（2）列出其真值表（1）（2）真值表ABCF00000101001110010111011100010111思考题：写出如下图2（a）所示组合逻辑电路的表达式和真值表，然后用图2（b）所示的四选一数据选择器实现

8、。A1A0STD0D1D2D34选1MUXY图2（a）图2（b）解：A1A0STD0D1D2D