2012数字电子技术练习题

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1、一、填空1．4位十六进制数转化为二进制数有__16____位。2．时序电路可分为(米里)Mealy型和__（莫尔）Moore__型。3．逻辑代数三种基本运算为与逻辑、或逻辑、非逻辑。4． 十进制整数转换成二进制整数的方法是    基数连除取余法    。5．（39）10=(  100111  )2;（87）10=(  10000111 )8421BCD6．门电路的扇出系数N指的是  保证门电路输出正确的逻辑电平和不出现过功耗的前提下，其输出端允许链接的同类门输入端数 。7．七段数码显示器有两种接法，称   共阳极接 法和共阴极接    法。它的七段是指   七个发光段   。8常用的组

2、合逻辑电路有   半加器与全加器     、  编码器与译码器      、  数据选择器与多路分配器      和   数据比较器      。9．基本RS触发器的“0”和“1”态是以 输出   （输入，输出）端的状态定义的，其逻辑函数为    Q(n+1次方) =Sd-(非)+Rd*Q(n次方)       ，   Rd-(非)*Sd-（非）=0    。10．常用的触发方式，一般有电平触发和   边沿    触发。其中，  边沿        触发器可以有效地避免空翻现象。十进制D八进制O十六进制H二进制B11．二进制(10100)2对应的十进制数为（20）10，十六进制数为14

3、。12．二进制(0.1101)2对应的八进制数为0.64，十六进制数为0.D。13．八进制(4.5)8对应的十进制数为4.625，二进制数为100.101。14．十进制数(15.25)D对应的八进制数为17.2，二进制数为1111.01。15．余3码10010110.1100对应的8421码为01100011.1001，十进制数为63.9。16．TTL三态电路的三种可能输出状态是高电平，低电平，高阻状态。17．组合逻辑电路当前输出只与当前输入有（有、无）关，而且与过去的输入无15（有、无）关。18．19.为使F=A，则B应为何值（高电平或低电平）？B:高B:低B:低20.为使F=，则A

4、应为何值（高电平或低电平）？A：高A：低A：高21.已知函数表达式为，则它的对偶式G=，反演式=。22．在数字电路中，逻辑变量的值只有2个。23．在逻辑函数的化简中，合并最小项的个数必须是2的n次方个。24．化简逻辑函数的方法，常用的有卡诺图法和代数法。1525．逻辑函数A、B的同或表达式为A⊙B=(用与或式表示)。26．4线—10线译码器又叫做10进制译码器，它有4个输入端和10个输出端,6个不用的状态。27．T触发器的特性方程Qn+1=T（+）Q的n次方。28．组成计数器的各个触发器的状态，能在时钟信号到达时同时翻转，它属于同步时序计数器。29．四位双向移位寄存器74LS194A的

5、功能表如表所示。由功能表可知，要实现保持功能，应使R0=1,S1=0,S0=0，当RD=1；S1=1,S0=0时 ，电路实现左移功能。74LS194A的功能表 RDS1S0工作状态01111××00011011置零保持右移左移并行输入30．若要构成七进制计数器，最少用3个触发器，它有1个无效状态。31．根据触发器结构的不同，边沿型触发器状态的变化发生在CP上升沿或下降沿时，其它时刻触发器保持原态不变。32． 格雷码的特点是相邻两个码组之间有1位码元不同。  33． 要使JK触发器置1，则应使JK=10。  34． 若1101是2421BCD码的一组代码，则它对应的十进制数是7  35．

6、 在组合逻辑电路中，若其输出函数表达式满足F=A+/A或F=A*A—（A非）就可能出现冒险现象。  4.时序逻辑电路按照其触发器是否有统一的时钟控制分为同步15时序电路和异步时序电路。5.由n位移位寄存器组成环形计数器，其进位模为n，若组成扭环形计数器，其进位模为2n。9.奇校验码的任意一组码组中，１的个数总是奇数　个。二、选择1．AB+A在四变量卡诺图中有(  C    )个小格是“1”。A.13          B.12          C.8          D.52．16位输入的二进制编码器，其输出端有(   C   )位。A.256          B.128    

7、      C.4          D.33．下列一组数中，C是等值的。①（A7）16②（10100110）2③（166）10A．①和③B.②和①C.②和③4．在逻辑函数中的卡诺图化简中，若被合并的最小项数越多（画的圈越大），则说明化简后C。A．乘积项个数越少B．实现该功能的门电路少C．该乘积项含因子少　　　　　　Ｄ．以上都不对5．在逻辑函数的卡诺图化简中，合并相邻项（画圈）的方法必须画成B形状。A．三角形B.矩形C.任意6．的最小项之和的形