数字电子技术测验 试卷七

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1、数字电子技术试题库数字电子技术试题七一、选择正确答案填空。（10分，每小题5分）Qn1.电路如图1.1所示。Qn+1=＋A的电路是﹠“1”﹠A1K(a)(b)(c)(d)图1.12.TTL主从JK触发器如图1.2(a)所示，初态为0，已知CP、A、B和SD的波形，请判断Q的波形，它应为（A）、（B）、（C）、（D）中的。1JSD（a）(b)图1.2二.将负边沿触发的JK触发器转换为T′触发器时，在不添加任何其它器件的条件下，有几种连接方案？请画出外部连接图（12分）。三.电路如图3.1所示。（20分）1．分析计数器电路

2、，设触发器初态为Q3Q2Q1＝001，指出计数器的模，画出状态转换图和电路时序图。2．若在使用过程中F2损坏，欲想用一负边沿D触发器代替，问电路应作如何修改，才能实现原电路功能。画出修改后的电路图。（可只画修改部分电路）。7数字电子技术试题库﹠﹠图3.1四.中规模同步四位二进制计数器和引脚简图分别如表4.1和图4.1所示。（15分）1.请用置零法设计一个七进制加法计数器，其状态转换要求如图4.2所示。2.试用一片74161及图4.3电路设计一个能自动完成加、减循环计数的计数器。即能从000加到111，再从111减到00

3、0循环，要有简要的设计过程。74161（74LS161）的功能表cpCRLDPTD3D2D1D0Q3Q2Q1Q0××0××××××××0000↑1×0××ABCDABCD×110××D0×××保持×11××××0××××↑1×111××××计数﹠Q3Q2Q1Q0：五.集成定时器CC7555的电路如图5.1（a）所示。(15分)1．用该集成定时器及在规格为100kΩ，200kΩ，500kΩ的电阻，0.01μF，0.1μF，1μF电容器中选择合适的电阻和电容，设计一个满足图5.1（b）所求波形的单稳态触发器。2．用该集成定

4、时器设计一个斯密特触发器，画出斯密特触发器的电路图。当输入为图5.2所示的波形时，画出斯密特触发器的输出u0波形7数字电子技术试题库VcovI1vI2v0v0′VDD11msu0RD0uI9V09V0ttt(a)(b)图5.1uI(v)9630t图5.2六.(17分）双积分式A／D如图6.1所示1．若被测电压uI(max)＝2V，要求分辨率≤0.1mV，则二进制计数器的计数总容量N应大于多少？2．需要多少位的二进制计数器？3．若时钟频率fcp=200kHz，则采样保持时间为多少？4．若fcp=200kHz，∣uI∣＜∣

5、uREF∣＝2V，积分器输出电压的最大值为5V，此时积分时间常数RC为多少毫秒？7数字电子技术试题库图6.1七.现有如图7.1所示的4×4字位RAM若干片，如要把它们扩展成8×8字位RAM。（11分）1．试问需要几片4×4字位RAM？2．画出扩展后电路图（可用少量与非门）。D3D2D1D04×4RAMA0A1CS图7.1数字电子技术试题七答案7数字电子技术试题库一、共10分5分/题（1）（C）（2）（B）二、共12分6分/波形波形：BAQ1Q2电路波形如左，它是一个单发脉冲发生器，A可以为随机信号，每一个A信号的下降沿

6、后；Q2端输出一个脉宽周期的脉冲。三、共20分1.写出每级触发器的状态方程（6分）111100010011001000101110分析后，其状态转换图为（4分）所以波形图为（3）CPQ1Q2Q3电路是一个同步五进制可以自启动的加法计数器（2分）2.（5分），当时，，当出现011状态时，使计数器的状态清0，故此种情况下，整个电路功能为一个三进制加法计数器。四、共5分（1）6分（2）9分1.进行加法计数实验时的电路连接如图，CP－=“1”，CP+接计数脉冲，Cr=0，接7数字电子技术试题库“1”，输出为QD、QC、QB、Q

7、A。LDCr“1”QDCBACT215DQCQBQAQCCQBBCPCP+CP－“1”2.要求按8421编码十进制减法计数时，状态转换图为0010000000011000011101010110100100110100QDQCQBQA由功能表可知，CT215是异步置数，因此当出现0000后，先出现1111，才能把计数器置成1001，随后开始减法计数，电路如下：（利用作计数控制）CPX0LDCr“1”QDCBACT215DQCQBQAQCCQBBCPCP－“1”“0”五、共20分1.555Ⅰ构成多谐振荡器2分7数字电子技

8、术试题库2.555Ⅱ组成单稳态触发器2分其中A2BtCt60t60403.A，B，C波形如图12分4.变宽2分5.单稳态触发器工作不正常，触发脉冲过宽，解决方法可以加微分后，再去触发555Ⅱ。2分六、共12分1.A/D分辨率即最小量化单位（6分）当时，2.转换误差（3分）3.可用两种措施：增加计数器位数（3分）采用四舍五入量化，在