2010年4月自考计算机系统结构试题与答案

2010年4月自考计算机系统结构试题与答案

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1、全国2010年4月自学考试计算机系统结构试题课程代码:02325一、单项选择题(本大题共10小题,每小题1分,共10分)在每小题列出的四个备选项中只有一个是符合题目要求的,请将其代码填写在题后的括号内。错选、多选或未选均不得分。1.在计算机系统结构设计中,提高软件功能实现的比例可(C)A.提高解题速度B.减少需要的存储器容量C.提高系统的灵活性D.提高系统的性能价格比2.浮点数表示的尾数的基rm=16,尾数长度p=8,可表示的规格化最大正尾数的值是(D)A.1/256B.1/2C.15/16D.255/2563.下列数据存储空间为隐含寻址方式的是(D)A.CPU中的通用寄存器B.主

2、存储器C.I/O接口中的寄存器D.堆栈4.当计算机系统执行通道程序完成输入输出工作时,执行通道程序的是(A)A.CPUB.通道C.CPU和通道D.指定的外设5.下列有关中断的叙述正确的是(A)A.中断响应的次序是由硬件决定的B.中断处理的次序是由硬件决定的C.中断处理的次序是不可改的D.中断响应的次序是可灵活改变的6.与虚拟存储器的等效访问速度无关的是(D)A.访存页地址流B.页面替换算法C.主存的容量D.辅存的容量7.非线性流水线的特征是(B)A.一次运算中使用流水线中的多个功能段B.一次运算中多次使用流水线中的某些功能段C.流水线中某些功能段在各次运算中的作用不同D.流水线的各

3、功能段在不同的运算中可以有不同的连接8.属于集中式共享存储器结构的SIMD计算机是(B)A.ILLIACIVB.BSPC.CM-2D.MP-19.指令执行结果出现异常而引起的中断是(A)7A.程序性中断B.I/O中断C.机器校验中断D.外部中断10.下列关于脉动阵列机的描述,错误的是(C)A.脉动阵列机是由一组内部结构相同的处理单元构成的阵列B.脉动阵列机结构简单、规整,模块化强,可扩充性好C.脉动阵列机不适用于要求计算量大的信号/图像的处理D.脉动阵列机各PE间数据通信距离短、规则,使数据流和控制流的设计、同步控制等均简单、规整二、填空题(本大题共10小题,每小题2分,共20分)

4、请在每小题的空格中填上正确答案。错填、不填均不得分。11.使用多处理机的主要目的是用多个处理机____并发______执行多个任务来提高___解题速度_______。12.指令的操作码优化编码方法有___哈夫曼编码_______和____扩展编码______。13.在可表示浮点数的负数区间,规格化浮点数的最大负数值由尾数的____最大负数值______与阶码的____最小负数值______组合而成。14.输入输出系统的发展经历了三个阶段,对应于三种方式,即______程序控制I/O___、直接存储器访问(DMA)及_____I/O处理器_____方式。15.若TS是通道的设备选择时

5、间,TD是通道传送一个字节数据的传送时间,P为通道连接的外设台数,n为每台外设需要传送的字节数,那么,字节多路通道完成数据传送的时间Tbyte=___(Ts+Td)pn_______,选择通道完成数据传送的时间Tselect=___(Ts/n+Tp)pm_______。16.Cache存储器系统是由_____Cache_____和____主存______构成的二级存储系统。17.解释一条机器指令的微操作可归并成取指令、_____分析_____和_____执行_____三个部分。18.分布式存储器结构的并行处理机的每个处理单元PE都有自己的___局部_______存储器,只能被__本

6、处理单元________直接访问。19.程序员编程用的地址是___逻辑地址_______,主存物理地址是程序在主存中的___实际地址_______。20.根据对数据令牌处理方式的不同,可以把数据流计算机的结构分成___静态___________和____动态______两类。三、简答题(本大题共5小题,每小题6分,共30分)21.简述实现软件移植的统一高级语言途径存在的问题。722.简述设计RISC结构采用的基本技术。23.设某系统的中断源的中断请求优先级分为4级,从高到低为l、2、3、4。设中断级屏蔽位为“1”,对应屏蔽;中断级屏蔽位为“0”,对应开放。要求中断处理次序与中断响应

7、次序相同,请给出各级中断处理程序中断级屏蔽位的设置。(要求:先进行文字说明,再画出中断级屏蔽位表)24.设指令由取指、分析、执行和存结果四个子部件组成,每个子部件经过时间为t,连续执行12条指令。画出在度m为3的超流水线处理机上工作的时空图。725.画出ILLIACIV处理单元的互连结构,用PUi表示第i个处理单元(i=0,l,…,63)。四、简单应用题(本大题共2小题,每小题10分,共20分)26.设有一条3段流水线,各段执行时间依次为△t、3△t和△t。(1)分别

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