eda实验讲义(2015版)

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1、《EDA技术》实验讲义蔡剑华20湖南文理学院物电系电子技术教研室第一部分硬件资源说明（CycloneIVE系列的EP4CE22F17C8N芯片）1）PORTA信号分配PORTAFPGA管脚信号PORTAFPGA管脚信号PIN_1+5VPIN_2+5VPIN_3GNDPIN_4GNDPIN_5PIN_B3D0PIN_6PIN_A4D1PIN_7PIN_B4D2PIN_8PIN_A5D3PIN_9PIN_A14D4PIN_10PIN_B14D5PIN_11PIN_B11D6PIN_12PIN_B10D7PIN_13PIN_P

2、14D8PIN_14PIN_R14D9PIN_15PIN_N14D10PIN_16PIN_K16D11PIN_17PIN_K15D12PIN_18PIN_L16D13PIN_19PIN_L15D14PIN_20PIN_N16D15PIN_21PIN_C9A0PIN_22PIN_D3A1PIN_23PIN_A2A2PIN_24PIN_C3A3PIN_25PIN_A3A4PIN_26PIN_B5A5PIN_27PIN_A6A6PIN_28PIN_B6A7PIN_29PIN_A7A8PIN_30PIN_B7A9PIN_31PI

3、N_A11A10PIN_32PIN_B12A11PIN_33PIN_A12A12PIN_34PIN_B13A13PIN_35PIN_A13A14PIN_36PIN_D5A15PIN_37PIN_C11PIN_38PIN_J13PIN_39PIN_D12PIN_40PIN_D11PIN_41PIN_E9PIN_42PIN_E11PIN_43PIN_R16PIN_44PIN_N15PIN_45PIN_P16PIN_46PIN_P15PIN_47PIN_48PIN_49PIN_F8PIN_50PIN_F8PIN_51PIN_5

4、2PIN_53PIN_5420PIN_55PIN_56PIN_57PIN_F16SPI_I1PIN_58PIN_F15SPI_I2PIN_59PIN_D15SPI_I3PIN_60PIN_D16SPI_I4注意：从FPGA引出到PORTA、PORTB的所有信号线，在适配器板上均有其它器件复用，使用时一定要注意，请查看《E-Play-SOPC适配器原理图》或查看前面FPGA对其它芯片的管脚分配表。2）PORTB信号分配PORTBFPGA管脚信号PORTBFPGA管脚信号PIN_1NCPIN_2NCPIN_3NCPIN_4N

5、CPIN_5PIN_N12SPI_NSS1PIN_6PIN_J14SPI_CLK1PIN_7PIN_L13SPI_MISO1PIN_8PIN_J15SPI_MOSI1PIN_9PIN_R12PIN_10PIN_G15PIN_11PIN_D6E_UART_RPIN_12PIN_E6E_UART_TPIN_13NCPIN_14NCPIN_15PIN_M10E_ALEPIN_16PIN_T10E_IO1PIN_17PIN_T11ADJ_CLK/E_IO2PIN_18PIN_E10E_IO3PIN_19PIN_E8E_IO4PI

6、N_20NCPIN_21NCPIN_22NCPIN_23NCPIN_24NCPIN_25PIN_T13E_IO9PIN_26PIN_T12E_IO10PIN_27PIN_T15E_IO11PIN_28PIN_T14E_IO12PIN_29PIN_F13E_IO13PIN_30PIN_N9E_IO14PIN_31PIN_E7E_IO15PIN_32PIN_P6E_IO16PIN_33PIN_J16LCD_CPIN_34NCPIN_35NCPIN_36NCPIN_37PIN_N11E_IO5PIN_38PIN_P11E_IO

7、6PIN_39PIN_R11E_IO7PIN_40PIN_R10E_IO8PIN_41PIN_P9CPLD_1/M0PIN_42PIN_F9CPLD_2/M1PIN_43PIN_T7CPLD_3/M2PIN_44PIN_T6CPLD_4/M3PIN_45NCPIN_46NCPIN_47NCPIN_48NCPIN_49NCPIN_50NC…………PIN_69NCPIN_70NC3）系统复位及系统时钟分配：FPGA管脚网络或符号备注20PIN_E1SYS_CLK系统时钟PIN_M1Sys_nRST系统复位4）模式分配16个用

8、户IO单元IO1-IO16都是通过PORTB从FPGA直接引出，供用户二次开发使用，具体定义请参照PORTB的接口定义。16个拨码开关，16个按键，12个交通灯和蜂鸣器四周4个灯，8位数码管，4x4矩阵键盘，16x16点阵LED均是从底板的两片CPLD引出的，这些资源有IO方式和总线操作两种控制方式。当采用IO控制方