重庆大学计算机硬件基础复习题5

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1、计算机硬件技术基础复习题一．填空（20分）(1)在实地址方式下，中断类型码为4的中断矢量存放的起始内存地址为0010h，共占4字节。（2）微型计算机总线结构包含控制总线、数据总线、地址总线三总线。（3）8位二进制数10000000若是有符号数补码，其十进制值为-128，若是无符号数，其十进制值为128，若是压缩BCD码，其十进制值为80D。（4）80486内部结构由8个逻辑单元组成，其中高速缓存单元和浮点处理单元是80486特有的。这点些逻辑单元支持80486按6级流水线工作。（5）80486CPU的虚拟存储管理技术中，分段机制将逻辑

2、地址变换为线性地址，而分页机制将线性地址变换为在地址总线上传送的物理地址。（6）CPU某扩展存储器芯片的可寻址地址范围为1000H—17FFH，则其存储容量为2k字节。(7)8254有3个通道，各有6种工作方式，其中方式1为硬件可重触发单稳方式。（8）8254通道0工作在二进制定时方式，若输入脉冲频率为2MHz，要实现1ms定时输出，则其初值为2000。（9）如果当前AX寄存器值为1234H，若执行NEGAX后，AX值为EDCC，若执行NOTAX后，AX值为EDCBH。（10）80486在执行子程序调用时，将自动依次把cs和IP寄存器

3、的值压入堆栈。二．单项选择题（10分）（1）在保护模式下，80486段的长度最大可达：（d）a)64K字节b)1M字节c)16M字节d)4G字节（2）下面数据载体中，按容量递增，速度递减排列的是（a）a)CPU内部寄存器、高速缓存器、内存储器b)高速缓存器、CPU内部寄存器、内存储器c)内存储器、CPU内部寄存器、高速缓存器d)内存储器、高速缓存器、CPU内部寄存器（3）若要求8255APA口工作在方式1输入，且要允许中断，则可选择下面（b）作为方式控制字。a)90hb)b0hc)80hd)30h（4）8259A工作在自动优先级循环方

4、式下，当前IR5上的中断请求已被响应并返回，则8个中断源中优先级最高的是（C）a)IR0b)IR4c)IR6d)IR5（5）机器周期（总线周期）、时钟周期、指令周期的关系为：（B）a)一个时钟周期包含几个总线周期，一个指令周期又包含几个时钟周期b)一个总线周期包含几个时钟周期，一个指令周期又包含几个总线周期c)一个总线周期包含几个时钟周期，一个时钟周期又包含几个指令周期d)一个总线周期包含几个指令周期，一个指令周期又包含几个时钟周期一．判断正误，错误的简单说明理由，并修改（16分）（1）超流水线结构和超标量结构是同一概念答：错误，二者

5、不是同一概念。超流水线结构是指CPU由多个逻辑部件组成因而所支持的多级流水线结构。超标量结构是指在CPU内部存在两条或两条以上的流水线。（2）80486在保护虚地址方式和虚拟8086方式采用相同的I/O保护机制。答：错误，二者I/O保护机制有别。80486在保护虚地址方式下对I/O的访问先考虑IOPL，若不满足再考察位于TSS高端的I/O允许位印象区。而虚拟8086方式只考察I/O允许位印象区。（3）高速缓存的主要功能是扩充内存容量。答：错误，用于提高内存访问速度。（4）通过8259A与CPU相连接的外设只能用中断方式与CPU交换信息

6、答：错误，还可用查询方式。通过写入OCW3，可指定8259工作在查询方式，此时CPU可查询8259的偶地址得到有无中断请求及最高优先级编码，从而转向相应的程序。一．简答（24分）（1）简述三线菊花链总线仲裁的原理及其优缺点。P239（2）举例说明组合BCD码相加后（DAA）的调整原则。答：对运算结果进行以下的调整+06调整：最高位无进位且高半字节为正常BCD码，低半字节有进位或非法BCD码+66调整：最高位有进位或高半字节为非法BCD码，低半字节有进位或非法BCD码+60调整：最高位有进位或高半字节为非法BCD码，低半字节无进位且为正

7、常BCD码+00调整：最高位无进位且高半字节为正常BCD码，低半字节无进位且为正常BCD码（3）阅读下面程序段：DATASEGMENTBUFDB‘INPUTERROR!’,0DH,0AH,’$’；在数据段定义一个字符串DATAENDSCODESEGMENTASSUMECS:CODE,DS:DATASTART:MOVAX,DATAMOVDS,AX；DS初始化，指向数据段MOVAH,01HINT21H；从PC键盘读入一个字符，其ASCII码存入ALCMPAL,’A’JBNEXT；若小于‘A’，转到NEXT，显示出错信息。CMPAL,’Z’

8、JANEXT；若大于‘Z’，转到NEXT，显示出错信息。ORAL,00100000B；转为小写字母。MOVDL,ALMOVAH,02HINT21H；显示该字母JMPDONE；转向程序尾NEXT:LEADX,BUFMOVA