数字电子技术离线作业

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1、模拟题一一、单项选择1、数字信号是(b)。(a)时间和幅值上连续变化的信号(b)时间和幅值上离散的信号(c)时间上连续、幅值上离散变化的信号(c)时间上离散、幅值上连续变化的信号2、处理(d)的电子电路是数字电路。(a)交流电压信号(b)直流信号(c)模拟信号(d)数字信号3、数字电路中，晶体管的工作于(d)状态。(a)放大(b)饱和(c)截止(d)开关4、在设计过程中，逻辑函数化简的目的是(b)。(a)获得最简与或表达式(b)用最少的逻辑器件完成设计(c)用最少的集电门完成设计(d)获得最少的与项5、10-4线优先编码器允许同时输入(d)路编码信号。(a)1(b)9(c)10(d)

2、多6、要使JK触发器的输出Q从1变成0，它的输入信号JK应为(b)。(a)00(b)01(c)10(d)无法确定7、TTL集成单稳态电路的暂稳态时间tW为___(a)___。(a)(b)(c)(d)8、n位环形移位寄存器的有效状态数是(a)。(a)n(b)2n(c)4n(d)2n9、以下可编程逻辑器件中，集成密度最高的是(d)。(a)PAL(b)GAL(c)HDPLD(d)FPGA10、若双积分A/D转换器第一次积分时间T1取20mS的整倍数，它便具有(b)的优点。(a)较高转换精度(b)极强抗50Hz干扰(c)较快的转换速度(d)较高分辨率二.填空题（请在空格中填上合适的词语，将题

3、中的论述补充完整）1、人们习惯的数制是十进制，在数字电路中常用的数制是二进制。2、在晶体三极管c、b极间并接肖特基二极管，可提高晶体三极管开关速度。3、基本译码电路除了完成译码功能外，还能实现逻辑函数发生和DMUX功能。4、用74LS138译码器实现多输出逻辑函数，需要增加若干个与非门。5、触发器按逻辑功能可分为RS触发器、JK触发器、T触发器、D触发器4种最常用的触发器。6、TTL与非门构成的微分单稳电路中，若出现时，可采用_微分电路_电路解决。7、4个触发器构成的行波计数器，其最大计数长度为16。8、按照数据写入的方式，ROM可分为掩脱ROM、PROM、EPROM、和E2PROM

4、等四类。9、一10位ADC的最小分辨电压为8mV，采用四舍五入的量化方法，若输入电压为5.337V，则输出数字量为(1010011011)2。10、8位并行比较型A/D转换器内比较器数量应为255。三、试分析图4.3所示电路的逻辑功能。图4.3[解](1)由逻辑图写出表达式并变换可以设中间变量L1、L2、L3、L4，由输出到输入写出S的表达式CBAS00000101001110010111011101101001(2)列逻辑真值表见右表。(3)由分析可知,该电路的功能是一个3输入奇校验电路，即当输入变量中1的个数为奇数时，输出S=1；否则S=0。图5.4四、已知CMOS边沿触发结构J

5、K触发器各输入端的电压波形如图5.4所示，试画出、对应的电压波形。、对应的电压波形如图所示。五、电路如图6.5所示。(1)分析S未按下时电路的工作状态。u0处于高电平还是低电平？电路状态是否可以保持稳定？(2)若C=10μF，按一下启动按钮S，当要求输出脉宽tw=10S时，计算R值。(3)若C=0.1μF，要求暂稳时间tw=5mS时求R值。此时若将C改为1μF（R不变），则时间tw又为多少？1、S未闭合时，uTR=VCC，若输出为低电平，放电管导通，uTH=0V，根据555的功能表知输出保持低电平；若输出为高电平，放电管截至，C充电，uTH=UC上升，当uTH≥2/3VCC时，输出跃

6、变为低电平，同时放电管导通，使uTH=0V。综上所述，uO处于低电平，电路状态可保持稳定。2、3、，【解】(1)S未闭合时，uTR=VCC，若输出为低电平，放电管导通，uTH=0V，根据555的功能表知输出保持低电平；若输出为高电平，放电管截至，C充电，uTH=UC上升，当uTH≥2/3VCC时，输出跃变为低电平，同时放电管导通，使uTH=0V。综上所述，uO处于低电平，电路状态可保持稳定。(2)(3)，六、一同步时序电路如图7.6所示，设各触发器的起始状态均为0态。(1)作出电路的状态转换表；(2)画出电路的状态图；(3)画出CP作用下各Q端的波形图；(4)说明电路的逻辑功能。图7

7、.6【解】(1)写出状态转换表如下表所示；CP01234567000001010011100101110111001010011100101110111000(2)画出状态转换图如图(a)所示；图(a)(3)画出波形图见图(b)所示；图(b)(4)由状态转换图可看出该电路为同步8进制加法计数器。七、若采用图所示的量化电平划分方法，试计算6位并行比较型A/D转换器的最大的量化误差是多少?【解】若输入模拟电压仍为0~0.7V，6位并行比较型A/D转换器的单位量