八位二进制累加器

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1、摘要随着社会的发展，在生活和生产中，我们经常要用到二进制累加问题，为了提高运算速度，更大的节约时间，所以我做了这个八位二进制累加器来进行二进制的累加，主要内容为加法器和寄存器及一些简易的电容电阻等器件，来实现八位二进制的累加问题，这样就可以把复杂的问题具体化，从而提高生产与学习效率，极大地节约时间。关键词：二进制累加器目录一．课题名称……………………………………………………………二．主要功能(简要说明)………………………………………………三．电路原理图…………………………………………………………四.工作原

2、理分析………………………………………………………1.电路组成…………………………………………………………2.单个元器件性能…………………………………………………五.整体电路工作原理及EDA仿真和结果分析：……………………六.元器件选择（元器件明细表和参考价格，电路成本估算）……七．电路的制作与实验测试……………………………………………1.电路排布…………………………………………………………2.电路焊接…………………………………………………………3.电路的检查及测试………………………………………………4.调

3、试结果…………………………………………………………八．线路的改进意见：……………………………………………………九．思考题………………………………………………………………十．课程设计的收获和体会………………………………………………十一．参考文献……………………………………………………………一．课题名称：8位二进制累加器二．主要功能(简要说明)： 该电路将K3，K4设定的8位二进制数与74LS273中锁存的数相累加，并将结果通过发光二极管D1~D8显示出来。K1为累加键，每按以此累加一次。K2为清零键，用于将

4、累加和清零。三．电路原理图：四.工作原理分析1、电路组成：如图1所示，整个电路由一个8位高速寄存器、两个4位二进制全加器及一些电阻、电容、发光二极管组成，实现8位二进制累加器的功能。2、单个元器件的性能(一).74LS2738位高速寄存器(1).74LS273是8位高速寄存器。寄存器内有八个共用时钟信号的D型触发器，寄存器有异步主复位信号输入端（低电平有效）。这种芯片为20脚封装，引线之间距离为0.3ft其特点如下： 8位高速寄存器； 数据并行寄存共用时钟信号和主复位信号；输入箝位二极管限制端口高速效应 

5、 (2)．引脚符号名称符号名               称负载参数高电平低电平 CLK时钟信号(上升沿触发)输入端0.5U.L0.25U.L D数据输入端0.5U.L0.25U.L CLR主复位信号(低电平有效)输入端0.5U.L0.25U.L Q寄存器输出端10U.L5(2.5)U.L (3).真值表 CLR CLK D QLXXLH 上升沿HHH 上升沿LL 注：H=逻辑高电平；L=逻辑低电平;X=任意值.(4).74LS273引脚图(5).简要分析说明：74LS273是公用时钟信号和主复位信号的8

6、位并行数据寄存器。当输入端为低电平时，Q输出端为低电平且与其他输入端无关。在时钟信号由低电平向高电平跳变时刻，达到规定的建立时间和保持时间要求的D端输入数据将被传送到Q输出端。 74ls273引脚图引脚功能：74LS273是8位数据/地址锁存器74LS273是一种带清除功能的8D触发器，1D～8D为数据输入端，1Q～8Q为数据输出端，正脉冲触发，低电平清除，常用作8位地址锁存器。(二).CD40084位二进制全加器。(1.)CD4008是4位二进制全加器。其性能与特点如下： 有四个“和”输出端及一个平行进

7、位输出端;CC4008与CD4008、MC14008可以互换使用;主要用于二进制加法单元;采用16条外引线封装。(2).原理分析：如图所示，CD4008是4位二进制全加器，能够计算4位加法。分别为各自由低向高的四位输入，为四位和输出(3).真值表如下 输入输出     0000010001010011101000101101100111011111(4).CD4008引脚图五.整体电路工作原理及EDA仿真和结果分析：整个电路为一个八位二进制累加器，主要部件为两片CD4008，即四位二进制累加器，一片74L

8、S273，即十六位二进制寄存器，其余的为电阻电容等一些元器件。整体仿真的电路如下：当K3，K4控制的八个开关控制两个级联的二进制加法器CD4008（高电平为1，低电平为0），输入八个二进制数，并与寄存器74LS273中锁存的数相累加，由于开始时，寄存器中的数00000000，所以累加完之后即为最后结果，结果由八个发光二级管显示，由于八个发光二级管采用共阳极接法，所有当二极管负极为低电平时，其发光，负极为高电平时，达不到开启电压