拔河游戏机课程设计

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1、电子课程设计——拔河游戏机学院：专业班级：姓名：学号：指导老师：2011年12月一：设计任务与要求拔河游戏机用九个点评指示灯排成一行，开机后只有中间一个点亮，以此作为拔河的中心线，游戏双方各持一个按键，迅速不断按动的产生脉冲，谁按得快，亮点向谁的方向移动，每按一次，亮点移动一次。移动到任何一方终端指示灯亮，这一方就得胜，此时双方按键均无作用，输出保持，只有经复位后才能点亮，恢复到中心线。最后，显示器显示优胜者的盘数二：总体框图甲组按键乙组按键整形电路加减计数器译码器显示电路计数器（甲组优胜盘数）计数器（乙组优胜盘数）控制电路（1）整形电路：使甲，乙两组按出的脉冲经整形后形成一个占空比

2、较大的脉冲，这样就减少了一计数时另一计数为低电平的情况，从而使每一次按键都有可能进行有效的计数。（2）加减计数器：甲组按键按下时进行加法计数，乙组按键按下时进行减法计数，哪组按键快，计数器执行哪组所对应的计数。（3）译码器：将加减计数器输出的二进制数编译为十进制数，并控制显示电路的显示情况。（4）计数器：当游戏结束时，计数器进行计数。甲组胜出时，所对应的甲组计数器加一，乙组计数器不计数，乙组同样的道理。（5）显示电路：显示电路用电平显示灯显示甲乙双方按键快慢的情况。设计思路：甲，乙双方用按键的快慢来表示力量的大小，甲组按键快，则执行加法计数，乙组按键快，则执行减法计数。在游戏开始时，

3、可按复位键对加减计数器进行置数，根据题目要求，可置数为0（这里采用74LS192芯片，为异步置数），再由译码器输出送到显示电路，此时位于中间的灯亮，当比赛结束时，输出返回使计数器停止计数，输出保持。此时优胜的一方所对应的计数器加一，输的一方所对应的计数器不计数。三：选择器件为使硬件试验能够有效的进行，这里我们选择的器件都是数电实验器件接触过的器件。（1）74LS192同步二进制可逆计数器逻辑功能说明：74LS192为可预置的十进制同步加/减计数器，具有异步清零和异步置数功能。当清除端（MR）为高电平时，不管时钟端（CPD、CPU）状态如何，即可完成清除功能。当置入控制端（PL）为低电

4、平时，不管时钟CP的状态如何，输出端（Q0～Q3）即可预置成与数据输入端（P0～P3）相一致的状态。192的计数是同步的，靠CPD、CPU同时加在4个触发器上而实现。在CPD、CPU上升作用下Q0～Q3同时变化，从而消除了异步计数器中出现的计数尖峰。当进行加计数或减计数时可分别利用CPD或CPU，此时另一个时钟应为高电平。当计数上溢出时，进位输出端（TCU）输出一个低电平脉冲，其宽度为CPU低电平部分的低电平脉冲；当计数下溢出时，错位输出端（TCD）输出一个低电平脉冲，其宽度为CPD低电平部分的低电平脉冲。当把TCD和TCU分别连接后一级的CPD、CPU，即可进行级联。以下是有关74

5、LS192芯片的一些基本图示说明。74LS192管脚图74LS192管脚说明：当置入控制端（PL）为低电平时，不管时钟CP的状态如何，输出端3，2，6，7即可预置成与数据输入端15，1，10，9相一致的状态。可当成输出端14为置零端；11为置数端。3，2，6，7为输出端；14为置零端；5为加法计数端；4为减法计数端；12，13分别为进.借位端。74LS192逻辑符号图74LS192逻辑功能表74LS192内部原理图（2）3线-8线74LS138译码器逻辑功能说明：输入的3位二进制代码共有8种状态，译码器将每个输入代码译成对应的一根输出线上的高、低电平信号。图（1）为3线-8线译码器7

6、4LS138的逻辑符号图，其有3个附加的控制端G1、G2A和G2B。当G1=1、G2A+G2B=0时，其附加门GS才输出高电平（S=1），译码器处于工作状态。否则译码被禁止，所有的输出端被封锁在高电平，这三个控制端也叫做“片选”输入端，利用片选的作用可以将多片连接起来以扩展译码图（2）3线-8线译码器74LS138的逻辑符号图，图（3）为74LS138的内部原理图，表（1）为3线－8线译码器74LS138的功能表，由3线-8线译码器74LS138的功能表也可以看出，当S1=0时，无论S2+S3等于0还是1，译码器都处于禁止状态，当S1=1,S2+S3=0时，译码器处于工作状态。74L

7、S138的逻辑符号图图（2）74LS138的逻辑框图图（3）74LS138的内部原理图表（1）3线－8线译码器74LS138的功能表输入输出S1S2+S3A0A1A0Y0Y1Y2Y3Y4Y5Y6Y70X11111111X100000000XX00001111XX00110011XX0101010111011111111110111111111101111111111011111111110111111111101111111111011111111110（