北邮通信原理硬件实验报告

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时间:2018-07-17

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1、通信原理硬件实验报告学院:信息与通信工程学院班级:学号:班内序号:姓名:39/39实验一:双边带抑制载波调幅(DSB-SCAM)一、实验目的:(1)了解DSB-SCAM信号的产生以及相干解调的原理和实现方法;(2)了解DSB-SCAM信号波形以及振幅频谱特点,并掌握其测量方法;(3)了解在发送DSB-SCAM信号加导频分量的条件下,收端用锁相环提取载波的原理及其实现方法;(4)掌握锁相环的同步带和捕捉带的测量方法,掌握锁相环提取载波的调试方法。二、实验系统框图:DSB-SC加导频的产生39/39测量VCO压控灵敏度的框图DSB-SC加导频分量的相干解

2、调及载波提取框图三、实验步骤:SC-DSB信号的数学表达式为s(t)=Acm(t)cos(Wct),这个实验产生SC-DSB的方法很简单,就是用载波跟调制信号直接相乘,其中载波是由主振荡器产生为幅度为1V,频率为100KHZ39/39的正弦波,而调制信号由音频振荡器产生的正弦信号再经缓冲放大器组成,幅度为1V,频率为1KHZ。1、DSB-SCAM信号的产生1)按照图连接,将音频振荡器输出的模拟音频信号及主振荡器输出的100KHz模拟载频信号分别用连接线连至乘法器的两个输出端;2)用示波器观看音频输出信号的信号波形的幅度以及振荡频率,调整音频信号的输出

3、频率为10kHz,作为均值为0的调制信号m(t);3)用示波器观看主振荡器输出信号的幅度以及振幅频谱;4)用示波器观看乘法器的输出波形,并注意已调信号波形的相位翻转与已调信号波形;5)测量已调信号的波形频谱,注意其振幅频谱的特点;6)调整增益G=1:将加法器的B输出端接地,A输入端接已调信号,用示波器观看加法器的输出波形以及振幅频谱,使加法器输入与加法器输出幅度一致;7)调整增益g;加法器A端接已调信号,B接导频信号。用频谱仪观看加法器输出信号的振幅频谱,调节增益g旋钮,使导频信号振幅频谱的幅度为已调信号的边带频谱幅度的0.8倍。此导频信号功率为已调

4、信号功率的0.32倍。2、DSB-SCAM信号的相干解调及载波提取1)锁相环的调试1单独测量VCO的性能将VCO模板前面板的频率开关拨到HI载波频段的位置,VCO的Vin输入端暂不接信号。用示波器看VCO的输出波形及工作频率f0,然后旋转VCO模板前面板的f0旋钮,改变VCO的中心频率F0,其频率范围为70~130kHz;然后将可变直流电压模块的DC输出端与VCO模块的Vin端相连,双踪示波器分别接于VCO的输出端与DC的输出端。调节VCO的GAIN旋钮,使得可变直流电压为正负1V时的VCO的频率偏移为正负10KHz。单独测试锁相环中的相乘、低通滤波

5、器是否正常工作。按电路图进行实验,即锁相环处于开环状态。锁相环中的LPF输出端不要接至VCO的输入端。此时图中的乘法器相当于混频器。在实验中,将另一VCO作为信号输入源输入于乘法器。改变信源VCO的中心频率,用示波器观看锁相环的相乘、低通滤波器的输出信号,它应是输入信号与VCO输出信号的差拍信号。2测量锁相环的同步带以及捕捉带按图将载波提取的锁相环闭环连接,人使用另一VCO作为输入与锁相环的信号源,如下面的连线图所示:39/39锁相环在锁定状态下,向上或向下改变输入信号参考频率fR使之远离VCO的中心频率f0,则当输入信号频率超过某边界值后,VCO便

6、不能在跟踪输入的变化,环路失锁。向上或向下改变输入信号频率对应有两个边界频率,成称这两个频率的差值为同步带。锁相环在失锁状态下,向上或向下改变输入信号参考频率fR使之接近VCO的中心频率f0,则当输入信号频率进入某边界值后,VCO将能跟踪输入的变化,环路锁定。向上或向下改变输入信号频率对应有两个边界频率,成称这两个频率的差值为捕捉带。在上述基础上,当VCO的压控灵敏度为10KHz/V时,此锁相环的同步带约为12KHz,对应的Vin输入的直流电压为±0.6。最后将主振荡器模块的100KHz余弦信号输入于锁相环,适当调节锁相环VCO的f0旋钮,使锁相环锁

7、定于100KHz,此时LPF输出的直流电压约为零电平。2)恢复载波1将锁相环按上述过程调好,连接,将加法器的输出信号接至图2.2.3锁相环的输入端。移相器的频率选择开关拨到HI位置。2用示波器观察LPF输出信号是否是直流信号,以此来判断载波提取PLL是否处于锁定状态。3确定锁相环提取载波成功后,利用双踪示波器分别观察发端的导频信号及收端载波提取锁相环中的VCO输出经移相器后的信号波形。调节移相器中的移相旋钮,达到移相90度,使输入于相干解调的恢复载波与发来的导频信号不仅同频,也基本同相。4用频谱仪观察恢复载波的振幅频谱。3)相干解调1在上述实验的基础

8、上,将相干解调的相乘、低通滤波器模块连接上,并将发送来的信号与恢复载波分别连至相干解调的乘法器的两个输入端。

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