基于verilog的数字时钟设计

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1、基于verilog的数字时钟设计姓名：张明学号：09325130专业：电子信息工程班级：093251指导教师：朱志甫2012年11月9日摘要随着基于CPLD的EDA技术的发展和应用领域的扩大与深入，EDA技术在电子信息、通信、自动控制用计算机等领域的重要性日益突出。作为一个学电子信息专业的学生，我们必须不断地了解更多的新产品信息，这就更加要求我们对EDA有个全面的认识。本程序设计的是基于VHDL的数字时钟。采用EDA作为开发工具，VHDL语言为硬件描述语言，QUARTUSII作为程序运行平台，所开发的程序通过调试运行、波形仿真验证

2、，初步实现了设计目标。本程序使用的硬件描述语言VHDL，可以大大降低了硬件数字系统设计的入门级别，让人感觉就是C语言的亲近。ABSTRACTWiththeEDA-basedCPLDdevelopmentandapplicationoftechnologytoexpandthefieldofdepth,EDAtechnologyinelectronicinformation,communications,automaticcontrolwiththeimportanceofcomputerandotherfieldshavebeco

3、meincreasinglyprominent..Asaprofessionalelectronicsandinformationsciencestudents,wemustcontinuetolearnmoreaboutthenewproductinformation,whichrequiresustomoreEDAhasacomprehensiveunderstandingof。Theprogramdesignisasimpleflowerdesign。TheuseofEDAasadevelopmenttool,VHDLlan

4、guageforhardwaredescriptionlanguage,MAX+PLUSIIprogramrunsasaplatformforthedevelopmentofproceduresbyrunningthroughthedebugging,waveformsimulation,theinitialrealizationofthedesigngoals。ThisprocedureusedinhardwaredescriptionlanguageVHDL,thehardwarecansignificantlyreducet

5、henumberofentry-levelsystemdesign,givepeopletheimpressionthatacloserelativeofClanguage.目录目录..................................................................................................................1需求分析..........................................................

6、................................................2系统框图说明..................................................................................................3设计步骤..........................................................................................................4Ver

7、ilog代码.....................................................................................................5功能仿真..........................................................................................................6实验总结.............................................

8、.............................................................7摘要............................................................