基于fpga的fir滤波器设计

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1、本报告分两部分:pork草鱼 1草鱼由matlab计算FIR数字滤波器的滤波系数;pork草鱼 2草鱼用VHDL语言设计逻辑电路,鲤鱼再通过QUARTUS草鱼II草鱼软件,鲤鱼将各个模块的电路封装成期间,鲤鱼在顶层设计中通过连线,鲤鱼完成整个系统。草鱼草鱼 所有源程序在本文档同一文件夹下的fir文件中。草鱼草鱼 草鱼 FIR数字滤波器的系数计算。草鱼草鱼 这里通过MATLAB的Fdatool软件实现。草鱼草鱼 输入数据S(n)为9位,鲤鱼输出y(n)为10位的低通滤波器草鱼 数据:pork各个参数如下:pork草鱼 Lilter草鱼Typer草鱼草鱼lowpass草鱼草鱼

2、FIR草鱼Window草鱼草鱼kaiser草鱼 草鱼 阶数:pork15,鲤鱼Beta=0.5,Fs=48kHz,Fc=10.8kHZ草鱼 草鱼 滤波类型为:pork直接型FIR草鱼 草鱼 草鱼 FIR滤波器的幅频响应草鱼 草鱼 草鱼 草鱼 相频响应草鱼 12草鱼 草鱼 FIR滤波器的冲击响应草鱼 草鱼 草鱼 滤波器系数草鱼 草鱼 草鱼 对系数进行调整,鲤鱼整数化:pork草鱼 Num草鱼=草鱼 草鱼-0.0742草鱼草鱼0.0234草鱼草鱼0.1133草鱼草鱼0.0117草鱼草鱼-0.1758草鱼草鱼-1.0977草鱼 0.3594草鱼草鱼草鱼0.8281草鱼草鱼0.8

3、281草鱼草鱼0.3594草鱼草鱼0.0977草鱼草鱼-0.1758草鱼草鱼草鱼 0.0117草鱼草鱼草鱼0.1133草鱼草鱼0.0234草鱼草鱼-0.0742草鱼 草鱼 草鱼 草鱼 12Num*(2^8)草鱼 草鱼 ans草鱼=草鱼 草鱼 草鱼草鱼Columns草鱼1草鱼through草鱼10草鱼 草鱼 草鱼草鱼-18.9952草鱼草鱼草鱼草鱼5.9904草鱼草鱼草鱼29.0048草鱼草鱼草鱼草鱼2.9952草鱼草鱼-45.0048草鱼-281.0112草鱼草鱼草鱼92.0064草鱼草鱼211.9936草鱼草鱼211.9936草鱼草鱼草鱼92.0064草鱼 草鱼 草鱼草

4、鱼Columns草鱼11草鱼through草鱼16草鱼 草鱼 草鱼草鱼草鱼25.0112草鱼草鱼-45.0048草鱼草鱼草鱼草鱼2.9952草鱼草鱼草鱼29.0048草鱼草鱼草鱼草鱼5.9904草鱼草鱼-18.9952草鱼 草鱼 草鱼 FIR数字滤波器的VHDL实现草鱼 根据作业要求,鲤鱼S(n)为9位,鲤鱼y(n)为10位的低通滤波器。草鱼数据:pork草鱼 草鱼 -19,6,29,3,-45,-25,92,212,212,92,-25,-45,3,29,6,-19草鱼 草鱼 阶数:pork15,鲤鱼Beta=0.5,Fs=48kHz,Fc=10.8kHZ草鱼 草鱼草鱼

5、草鱼草鱼滤波类型为:pork直接型FIR草鱼 草鱼草鱼草鱼草鱼FIR滤波器的原理图设计如下:pork草鱼 草鱼 草鱼草鱼草鱼草鱼设计原理:pork草鱼 草鱼 一草鱼概要草鱼 草鱼 12我的原理说明是根据上面原理图的设计顺序逐步进行的。草鱼草鱼 1草鱼寄存器(延时器)。草鱼草鱼 草鱼草鱼草鱼草鱼原理图上标有dff9的器件。草鱼输入9位数据,鲤鱼通过dff9的D触发寄存器,鲤鱼达到延时的作用。草鱼草鱼 2草鱼第一级加法器草鱼 草鱼草鱼草鱼草鱼数据通过add9910,就是9位数字输入,鲤鱼10位数字输出加法器,鲤鱼完成第一级相加运算,鲤鱼因为本题是16阶FIR数字滤波器,鲤鱼它

6、的滤波系数有对称的关系,鲤鱼所以采用上面的第一级加法器,鲤鱼达到简化运算的效果。草鱼草鱼 3草鱼乘法器草鱼 乘法器用来将数据乘以由matlab计算得到的滤波系数,鲤鱼本题的系数分别为:pork-19,6,29,3,-45,-25,92,212。草鱼草鱼 在乘法器设计时暂时没有考虑符号,鲤鱼符号问题由下面的减法器实现。草鱼即:pork若系数符号为负,鲤鱼那么在下一级用减法器减去乘法器所得的数据。草鱼所有的乘法器为:porkmult19,草鱼mult草鱼mult草鱼6,草鱼mult草鱼29,草鱼mult草鱼3,草鱼mult草鱼45,草鱼mult草鱼25,草鱼mult草鱼92,

7、草鱼mult草鱼212。草鱼草鱼 4草鱼第二级加,鲤鱼减法器草鱼 第二级加法器主要有add111414,add151415,add161717。草鱼add111414就是说11位数据加14位数据输出14位数据,鲤鱼说有的都是相同的命名规则。草鱼减法器的作用是反映乘法器的负号的,鲤鱼对于负的滤波系数,鲤鱼在此相当于经过减法器相减。草鱼草鱼 5草鱼第三级加,鲤鱼减法器草鱼 与上一级大体相同的原理。草鱼草鱼 6草鱼输出草鱼 输出通过add141710,鲤鱼将上一级得到的14位和17位数据相加,鲤鱼再拿出相加结果的高十位作为输出。草鱼

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