基于fpga的rs-232串口通讯逻辑设计

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1、草鱼 本草鱼科草鱼毕草鱼业草鱼设草鱼计草鱼 题目:基于FPGA的RS-232串口通讯逻辑设计草鱼 草鱼 草鱼 草鱼 姓草鱼草鱼草鱼草鱼名草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼杨常伟草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 学草鱼草鱼草鱼草鱼院草鱼草鱼草鱼草鱼信息与电气工程学院草鱼草鱼草鱼 专草鱼草鱼草鱼草鱼业草鱼草鱼草鱼草鱼电气工程及其自动化草鱼草鱼草鱼 年草鱼草鱼草鱼草鱼级草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼2008级草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 学草鱼草鱼草鱼草鱼号草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼20082926113

2、草鱼草鱼草鱼草鱼草鱼草鱼草鱼 指导教师草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼韩草鱼辅草鱼君草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 2012草鱼年草鱼6月草鱼10日草鱼 草鱼 草鱼 独草鱼创草鱼声草鱼明草鱼 本人郑重声明:所呈交的毕业论文(设计),鲤鱼是本人在指导老师的指导下,鲤鱼独立进行研究工作所取得的成果,鲤鱼成果不存在知识产权争议。草鱼尽我所知,鲤鱼除文中已经注明引用的内容外,鲤鱼本论文(设计)不含任何其他个人或集体已经发表或撰写过的作品成果。草鱼对本文的研究做出重要贡献的个人和集体均已在文中以明确方式标明。草鱼草鱼 此声明的法

3、律后果由本人承担。草鱼草鱼 草鱼 草鱼作者签名:草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼二〇一草鱼草鱼年草鱼草鱼草鱼月草鱼草鱼草鱼日草鱼 草鱼 草鱼 毕业论文(设计)使用授权声明草鱼 本人完全了解鲁东大学关于收集、保存、使用毕业论文(设计)的规定。草鱼草鱼 本人愿意按照学校要求提交论文(设计)的印刷本和电子版,鲤鱼同意学校保存论文(设计)的印刷本和电子版,鲤鱼或采用影印、数字化或其它复制手段保存论文(设计);同意学校在不以营利为目的的前提下,鲤鱼建立目录检索与阅览服务系统,鲤鱼公布论文(设计)的部分或全部内容,鲤鱼允

4、许他人依法合理使用。草鱼草鱼 (保密论文在解密后遵守此规定)草鱼 草鱼 论文作者(签名):草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 二〇一草鱼草鱼年草鱼草鱼月草鱼草鱼日草鱼 草鱼 毕业设计选题报告姓名杨常伟性别男学院信息与电气工程学院年级2008级学号20082926113设计题目基于FPGA的RS-232串口通讯逻辑设计课题来源教学课题类别应用研究选做本课题的原因及条件分析:草鱼 现代社会的标志之一就是信息产品的广泛使用,鲤鱼而且是产品的性能越来越强,鲤鱼复杂程度越来越高,鲤鱼更新步伐越来越快。草鱼支撑信息电子产品

5、高速发展的基础就是微电子制造工艺水平的提高和电子产品设计开发技术的发展。草鱼前者以微细加工技术为代表,鲤鱼而后者的代表就是EDA(electronic草鱼design草鱼automatic,电子设计自动化)技术。草鱼而FPGA(Field-Programmable草鱼Gate草鱼Array,鲤鱼现场可编程门阵列)是特殊的ASIC芯片,鲤鱼与其它的ASIC芯片相比,鲤鱼它具有设计开发周期短、设计制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检测等优点。草鱼而串行通信技术又有比较成熟的技术与其特有的优点被普遍

6、应用,鲤鱼因此设计此课题具有很强的的实用性和发展性。草鱼指导教师意见:草鱼 草鱼 草鱼草鱼 草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼签名:草鱼 草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 年草鱼草鱼草鱼草鱼月草鱼草鱼草鱼草鱼草鱼日院(系)毕业论文(设计)领导小组意见:草鱼 草鱼 草鱼 草鱼 草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼

7、草鱼草鱼草鱼草鱼(公章)草鱼 草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼草鱼 年草鱼草鱼草鱼草鱼月草鱼草鱼草鱼草鱼草鱼日草鱼 毕业设计任务下达书草鱼 草鱼 学院草鱼信息与电气工程学院草鱼专业草鱼计算机科学与技术草鱼学号草鱼0322110213草鱼姓名草鱼杨常伟草鱼草鱼 现将毕业设计任务下达书发给你。草鱼毕业设计任务下达书内容如下:草鱼 毕业设计题目草鱼 草鱼草鱼草鱼草鱼基于FPGA的RS-232串口通讯逻辑设计草鱼 主要内容草鱼 1.草鱼基于FPGA的RS-232串口通讯逻辑设计的实现方法的选择;草鱼 2.草鱼基于FPGA

8、的RS-232串口通讯逻辑设计数据的接受发送模块的程序设计及其仿真实验;草鱼 3.草鱼基于FPGA的RS-232串口通讯逻辑设计接收到的数据的数码管显示。草鱼草鱼草鱼 4.基于FPGA的RS-232串口通讯逻辑设计的上机测试。草鱼草鱼 具体要求草鱼 利用VHDL语言编写程序实现基于FPGA

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