简易逻辑分析仪的设计

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1、平顶山工学院毕业设计（论文）毕业设计[论文]题目：简易逻辑分析仪的设计系别：电气与电子工程系专业：电气工程及其自动化姓名：学号：指导教师：平顶山工学院2008年05月28日44平顶山工学院毕业设计（论文）目录目录1摘要2Abstract3简易逻辑分析仪4第一章绪论41.1选题的目的和意义41.2逻辑分析仪的基本组成原理41．3逻辑分析仪的主要技术指标及发展趋势6第二章方案论证与比较72.1数字信号发生器模块72.2逻辑分析仪模块8第三章信号发生器实现方案113.1硬件组成113.2软件组成14第四章简易逻辑分析仪方案实现154.1结构组成154.2数据采集和

2、存储部分164.3逻辑状态与波形显示部分174.4简易逻辑分析仪的软件流程234.5实时波形存储与上下翻页25第五章：操作说明265.1数字信号发生器操作方法275.2逻辑分析仪操作方法27第六章附录28第七章总结42致谢4344平顶山工学院毕业设计（论文）摘要本系统由8位可预置的循环移位数字信号发生器、简易逻辑分析仪两部分组成。循环移位数字信号发生器由51单片机控制，可以产生8位可预置逻辑信号序列和时钟信号波形。其中一路输出电平可在0～5V内调节。采用16×2液晶显示各设置参数，显示直观，设置方便。简易逻辑分析仪采用双单片机协同工作的方式：其中一片单片机作

3、输入控制、数据存储、数据显示及各控制参设置；另一片单片机控制D/A转换器输出波形到示波器。两单片机之间采用串行方式进行通信。我们采用XY扫描方式的显示方法。X轴的锯齿波信号由D/A转换器产生，由于要同时显示8路信号，所以Y轴的信号由被测信号、时标信号和参考电平相加得到，在软件配合下，可以比较方便实现8路信号的稳定显示，同时也可显示时间标志线和触发点位置。在本设计中，数据采集采用触发字触发方式。信号采集电路中采用门限电压调节电路，可以采集0.25～4V门限的各种逻辑电平，存储深度达到24bit，示波器可以实现对8路24bit信号同时显示。关键字：数字信号发生器

4、逻辑分析仪D/A转换器示波器存储深度44平顶山工学院毕业设计（论文）AbstractThesystemiscomposedoftwoparts,thesimplelogicalanalyzerandadigitalsignalgeneratorwhosevaluecanbepresetedThesignalgeneratoriscontrolledby51sianal-chipmicrocomputer,andcanbothgeneratea8bitsignalseriesandaCLKsigal..Oneofthevoltagecanbeadjustedb

5、etween0vand5v.AlltheparametersbeingreferredwillbedisplayedintheLiquid-crystaldisplayCA1602A,forwhichisveryconvenience.Thesimplelogicalanalyzeradoptsthewaytwosianal-chipmicrocomputersworkstogether.Onemicrocomputercontrollstheinput,datastorage,datadisplayandtheestablishmentofthedata,

6、andtheanotheronecontrollstheD/AconvertertodisplaythesignalfigureintheOscilloscope.Thetwoofthecomputerscommunicateswitheachotherintheseriesway.AlsowedisplaythewavethrougrXYscanningway.TheSaw-toothwavesignalintheXchannelisforgedintheD/Aconverter.Becausethe8groupssignalswillbediaplaye

7、dsimultaneously,thevoltageontheYwillbeequalledwiththesumsofthereferencevoltage,thetimeindicesignalandthesigalswhichwillbumeasured.Withthehelpofthesoftware,the8groupssignalswillbedisplayedstablely,alsothetimeinducelineandthetriggerpositionwillbeshowedintheOscilloscope.Inthissystem,t

8、hedatasamplingistriggedbyt