基于fpga的数字钟设计与实现

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1、基于FPGA的数字钟的设计与实现草鱼 基于FPGA的数字钟的设计与实现草鱼 　草鱼草鱼QuartusII草鱼是Altera草鱼公司的第四代可编程逻辑器件开发软件,它除承接原来MAX草鱼+草鱼PLUSII草鱼软件的全部设计功能和器件对象外,还增加了许多新功能和新的FPGA草鱼器件系列。草鱼Quartus草鱼II草鱼软件提供了一种与结构无关的全集成化环境,将设计、pork综合、pork布局和布线、pork系统的验证都整合到一个无缝的环境中,使设计者能方便地对Altera草鱼公司的PLD草鱼系列产品进行设

2、计输入、pork快速处理和器件编程。草鱼本设计就是在quartud草鱼II草鱼草鱼7.2，鲤鱼使用VHDL的方法实现基于FPGA的数字钟的设计与实现。草鱼草鱼 一．该数字钟电子钟的功能要求草鱼 数字钟首先具有计时、pork校时校分、pork整点报时、pork12小时/24小时切换功能。草鱼它由分频器、pork校时电路、pork计数器(2草鱼个60草鱼进制、pork1草鱼个24草鱼进制计数器)、porkBCD草鱼译码器、pork整点报时电路组成。草鱼外部555定时器产生1草鱼KHz草鱼的脉冲信号,经分

3、频器分频在其输出端可得到一个1Hz草鱼的脉冲信号。草鱼。草鱼1Hz草鱼秒脉冲输入秒计数器,经计数、pork译码输出到显示器,显示时、pork分、pork秒。草鱼计数值到23草鱼:草鱼59草鱼:草鱼59草鱼时返回00草鱼:草鱼00草鱼:00草鱼。草鱼整点报时电路的控制功能是,当分计数器为59草鱼,秒计数器为50草鱼、pork52草鱼、pork54草鱼、pork56草鱼、pork58草鱼时,QL草鱼=草鱼1草鱼;pork为00时Q草鱼H草鱼=草鱼1草鱼。草鱼再经逻辑门电路控制两路不同频率的信号送到蜂冥器

4、,每到一临近整点使其发出五高一低的报时声音。草鱼校时校分功能也是使用1HZ的时钟信号，鲤鱼当实现校时校分功能时，鲤鱼计时的分众和时钟以1HZ的频率递增，鲤鱼直到所要设定的时间，鲤鱼将拨动开关拨回，鲤鱼就实现了校时校分功能。草鱼而其中的12小时/24小时切换是采用一个按键开关来控制，鲤鱼这个模块输入输出分别接计时的时钟输出和BCD译码器的输入，鲤鱼具体实现是以下的sst模块功能。草鱼草鱼 第二该数字钟具有秒表功能，鲤鱼它由分频器、pork抖动消除电路、pork计数器(1个100，鲤鱼236基于FPGA

5、的数字钟的设计与实现草鱼个60草鱼进制、pork1草鱼个24草鱼进制计数器)、porkBCD草鱼译码器组成，鲤鱼外部555定时器产生1草鱼KHz草鱼的脉冲信号,经分频器分频在其输出端可得到一个100Hz草鱼的脉冲信号。草鱼100Hz的草鱼秒脉冲输入秒计数器,经计数、pork译码输出到显示器,显示从00草鱼:草鱼00草鱼:00：pork00开始计时的时、pork分、pork秒、pork0.01秒，鲤鱼该电路实现有两个按键开关用于秒表计时的走停控制还有秒表的清零。草鱼草鱼 第三该数字钟具有倒计时功能，鲤

6、鱼可设定倒计时的初始值。草鱼它由外部输入一个1HZ的时钟信号，鲤鱼设定初始值之后，鲤鱼将倒计时波动开关启动，鲤鱼使倒计时工作，鲤鱼之后倒计时就已1HZ的频率递减直至到0，鲤鱼然后此时接在输出的蜂鸣器就会以1HZ的频率响22秒钟的时间。草鱼草鱼 最后该时钟还有一个实现闹钟的功能，鲤鱼该功能模块使用计时功能的分钟和时钟的输出作为输入，鲤鱼当计时到达所设定的时间时，鲤鱼闹钟输出的蜂鸣器就以1HZ的频率响1分钟的时间。草鱼草鱼 实现上面的全部功能模块后，鲤鱼将四个功能模块和在一起，鲤鱼其中使用的时钟共享，鲤

7、鱼输入要显示的BCD译码器的输出通过自建的功能ch3模块实现各个功能的输出，鲤鱼也就是实现各部分功能之间的转化。草鱼所以各个功能模块的数码管的输出时共用的，鲤鱼现在将更模块及整体实现的原理如下：pork草鱼 二．各个功能模块实现的原理、pork模块代码及原理图草鱼 1.草鱼计时、pork校时校分、pork整点报时、pork12小时/24小时切换；pork草鱼 模块mian。草鱼该模块为60进制计数器，鲤鱼计时输出为秒的数值。草鱼在计时到59时送出信号co，鲤鱼所以模块mina在此模块变为00时加1。

8、草鱼代码如下：pork草鱼 草鱼 草鱼 36基于FPGA的数字钟的设计与实现草鱼 library草鱼ieee;pork草鱼 use草鱼草鱼ieee.std_logic_1164.all;pork草鱼 use草鱼草鱼ieee.std_logic_unsigned.all;pork草鱼 entity草鱼mian草鱼is草鱼 草鱼草鱼port(clk,clr:in草鱼std_logic;pork草鱼 草鱼草鱼草鱼草鱼草鱼sec1,sec0:out草鱼std_logic_ve