添加自定义ip核基本步骤

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1、添加自定义IP核基本步骤一、使用工具和参考链接：PlanAhead，XPS，SDK，ISE。http://xilinx.eetrend.com/blog/3987http://xilinx.eetrend.com/blog/4009二、自定义IP流程简图如下：三、功能简介：本次生成的IP核只是用来控制一个LED灯根据sdk工程中对寄存器赋值来亮和灭。四、步骤：1、使用PlanAhead创建新工程，打开PlanAhead14.4，创建新工程，输入工程名称，点击Next。注：14.1版本存在问题，在windows系统下使用PlanAhead14.1会出现错误，建议升级至14.4。1、选择RTLPr

2、oject，在Donotspecifysourcesatthistime处打钩，暂时不添加源文件。之后，选择所使用的FPGA型号。之后会有工程的简单summary，点finish完成。1、在工程左侧找到Addsources，添加xps工程。然后点击红色线框所示，弹出窗口，按下图所示进行设置。Next之后，弹出窗口，如下图所示，单击红色线框按钮，弹出如下图所示窗口，命名其为system。然后确定！如下图所示。点击Finish。弹出如图所示的窗口，选择yes，（此时创建BSP）1、创建xps工程。默认选择PLBSystem，点击ok。根据自己的情况设置硬件工程，本例子中设置为单核系统，只选择了最基

3、本的ddr，bram和串口三个。在出现整个硬件summary之后点击finish完成设置。1、添加自定义IP核，在Hardware中选择CreateorImportPeripheral添加IP核。如下面四个图所示，选择默认选项，在之后添加IP核名称，不能和PlanAhead以及xps工程名相同。如下面四个图所示，之后选择PLB总线，会提示所需要的功能，包括软件reset，用户寄存器（一般都需要这个），FIFO（看需求），内存空间，中断。本例子中只需要寄存器即可，如右上图。之后选择默认即可，然后是添加寄存器数量，根据自己的需要添加，本例子中需要存储led灯状态，因此需要一个寄存器。这里面的寄存器

4、都是32bit。如下图所示，之后添加所需要的PLB总线信号，基本保持默认即可。Next之后保持默认。在之后的选项中，如下图所示，第一个是用户逻辑语言选择，如果用vhdl则不用打钩，如果需要改成Verilog则打钩。第二个和第三个均打钩，让ise自动生成PLB的硬件接口和SDK中要用到的头文件。完成IP核的设置。1、编辑IP核的硬件逻辑。生成IP之后，可以在xps工程中看到添加的IP核，如下图所示，然后开始编辑它，打开目录*samplesample.srcssources_1edksystempcoresled_v1_00_adevlprojnav，*是工程的路径。打开.xis

5、e工程文件。我们会在ise工程中用到led.vhd和user_logic.v两个文件，如右图所示。在user_logic.v中，先添加需要用到的端口led1(注，端口名不能和IP核名称相同！)，并定义端口的属性，如下图所示。如下图所示，系统已经写好一个例程，来给出怎么读取和输入数据。之后就可以根据自己的需要编写相应的硬件逻辑。编写完成后，上面右图为编写完成后。需要在led.vdl文件中配置端口。打开此文件，如下图左图所示，添加端口的名称。在修改完这三处后，运行仿真，确认没有错误后，可以查看RTL原理图，确认端口是否添加。然后保存退出，回到xps工程中。在工程中重新扫描，如下图所示。右键点击左侧

6、生成的IP核LED，选择ViewMPD，如果port中没有LED端口，则手动添加代码：PORTLED="",DIR=O，并保存。之后添加IP核至xps工程中。如下面三个图所示，将IP挂在到PLB总线上，之后将LED的端口设置为外接端口，并命名，这个名字要记下来。然后为LED这个IP核分配地址。之后可以退出xps工程，回到PlanAhead中。1、如下图所示，右键点击system，创建TopHDL文件。然后为端口添加ucf文件约束，为此端口分配硬件管脚。接着使用AddSources添加约束文件，选择AddorCreateConstraints添加约束，完成保存即可生成bit流文件。在工程中，生成

7、硬件的bit流文件，即可导入至SDK中使用了。之后，将工程导入SDK，在弹出的窗口中，LaunchSDK打钩。OK在SDK中创建NewApplicationProject，选择MemoryTests。Finish。将硬件信息和头文件导入SDK。（这部分网上教程没有，需注意）生成的bit流文件在*samplesample.runsimpl_1download.bit这个文件即为硬件信息的输出