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1、试卷A一、选择题（从每小题的四个备选答案中，选出一个正确答案，并将其号码填在括号内，每小题2分，共20分）1.将十进制数（18）10转换成八进制数是[]①20②22③21④232.三变量函数的最小项表示中不含下列哪项[]①m2②m5③m3④m73.一片64k×8存储容量的只读存储器（ROM），有[]①64条地址线和8条数据线②64条地址线和16条数据线③16条地址线和8条数据线④16条地址线和16条数据线4.下列关于TTL与非门的输出电阻描述中，正确的是[]①门开态时输出电阻比关态时大②两种状态都是无穷大输出电阻③门关态时输出电阻比开态时大④两种状态都没有输出电阻5.以下各种ADC中，转换速度
2、最慢的是[]①并联比较型②逐次逼进型③双积分型④以上各型速度相同6.关于PAL器件与或阵列说法正确的是[]①只有与阵列可编程②都是可编程的③只有或阵列可编程④都是不可编程的7.当三态门输出高阻状态时，输出电阻为[]①无穷大②约100欧姆③无穷小④约10欧姆8.通常DAC中的输出端运算放大器作用是[]①倒相②放大③积分④求和9.16个触发器构成计数器，该计数器可能的最大计数模值是[]①16②32③162④21610.一个64选1的数据选择器有（）个选择控制信号输入端。[]①6②16③32④64二、填空题（把正确的内容填在题后的括号内。每空1分，共15分。）1．已知一个四变量的逻辑函数的标准最小项
3、表示为，那么用最小项标准表示，以及，使用最大项标准表示，以及。2．具有典型实用意义的可编程逻辑器件包括，，，。3．为了构成4K×16bit的RAM，需要块1K×8bit的RAM，地址线的高位作为地址译码的输入，地址译码使用的是译码器。4．在AD的量化中，最小量化单位为Δ，如果使用四舍五入法，最大量化误差为Δ，如果使用舍去小数法，最大量化误差为Δ。5．如果用J-K触发器来实现T触发器功能，则T,J,K三者关系为；如果要用J-K触发器来实现D触发器功能，则D,J,K三者关系为。三、简答题（每小题5分，共10分）1．用基本公式和定理证明下列等式：2．给出J-K触发器的特征方程，状态转移真值表，状态转
4、移图。四、分析题（25分）A0A1A2D0D1D2D3D4D5D6D7INHDISYCC4512CBA10F图4.1D1．8选1数据选择器CC4512的逻辑功能如表4.1所示。试写出图4.1所示电路输出端F的最简与或形式的表达式。（9分）表4.1CC4512功能表ISINHA2A1A0Y00000D000001D100010D200011D300100D400101D500110D600111D700×××01××××高阻2.如图4.2电路由CMOS传输门构成。试写出输出端的逻辑表达式。（8分）3．试分析图4.3所示时序电路。（8分）(1)该电路是同步的还是异步的？(2)列出状态转移表和画出状
5、态转移图，并说明电路的逻辑功能。五、设计题（30分）1．设计一个PLA形式的全减器。设A为被减数，B为减数，C为低位借位，差为D，向高位的借位为CO。完成对PLA逻辑阵列图的编程。（10分）2．试用555定时器设计一个多谐振荡器，要求输出脉冲的振荡频率为500Hz，占空比等于60％，积分电容等于1000pF。（10分）（1）画出电路连接图；（2）画出工作波形图；（3）计算R1、R2的取值。3．用中规模集成十六进制同步计数器74161设计一个13进制的计数器。要求计数器必须包括状态0000和1111，并且利用CO端作13进制计数器的进位输出。74161的功能表如下，可以附加必要的门电路（10分）
6、74161功能表输入输出RDLDETEPCPD0D1D2D3Q0Q1Q2Q30´´´´´´´´000010´´d0d1d2d3d0d1d2d31111´´´´计数110´´´´´´保持,CO=01110´´´´´保持图5.2试卷A_解答一、选择题（从每小题的四个备选答案中，选出一个正确答案，并将其号码填在括号内，每小题2分，共20分）1.②2.①3.③4.①5.③6.①7.①8.④9.④10.①二、填空题（把正确的内容填在题后的括号内。每空1分，共15分。）1．∑m(2,4,6,7,9,11,12,13,15)∑m(1,5,7,10,12,14,15)∏M(1,5,7,10,12,14,15)
7、∏M(0,2,3,4,6,8,9,11,13)2．PLA,PAL,GAL,CPLD等3．8，2，2-44．±，+15．T=J=K，D=J=三、简答题（每小题5分，共10分）1．证：右=左==右，证毕！2．特征方程：（1分）JK0001010111状态转移真值表：（2分）状态转移图：（2分）四、分析题（25分）1．（9分）解：根据数据选择器的工作原理，由图可得：2．（8分）解：F1=A（4分）F2=
