《计数器的设计》PPT课件.ppt

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1、数字逻辑与数字系统实验电子电工中心实验七：计数器的设计掌握计数器电路的设计方法学会利用集成计数器电路设计不同进制计数器学会Verilog语言状态机法计数器实验目的实验原理计数器的设计1、什么是计数器计数器可以实现计数（分频）、定时、产生节拍脉冲等。集成计数器通常具有计数、保持、预置数、清零(置0)等多种功能。2、计数器分类按进位方式，分为同步和异步计数器；按进位制，分为模二、模十和任意模计数器；按逻辑功能，分为加法、减法和可逆计数器；按集成度，分为小规模与中规模集成计数器；中规模集成计数器功能完善，具有自扩展特性，所以通用性很强。因此要求学生能看懂功能表，并且能熟练使用集成计数器。有关计

2、数器实验原理计数器的设计同步集成计数器74LS16074LS160是十进制同步加法计数器，具有计数、保持、预置、和清零功能实验原理计数器的设计管脚功能管脚功能1清零9置数信号2计数脉冲10使能3置数输入11计数输出4置数输入12计数输出5置数输入13计数输出6置数输入14计数输出7使能15进位输出8地16电源实验原理计数器的设计输入变量输出变量说明CLRLDENPENTCPDCBAQDQCQBQACO0××××××××00000异步置010××↑dcbadcbaCO1CO1=ENTQDQA1111↑××××计数CO2CO2=QDQA110××××××保持CO3CO3=ENTQDQA11×

3、0×××××保持01．异步置0功能。QDQCQBQA=0000。2．同步并行置数功能。CLR=1、LDN=0时，在CP上升沿作用下，QDQCQBQA=dcba。3．计数功能。CRN=LDN=1;ENP=ENT=1时，在CP的作用下，按照8421BCD码进行十进制加法计数。4．保持功能。当CRN=LDN=1、且ENP·ENT=0时，计数器状态保持不变。实验内容1计数器的设计1.174160十进制计数器测试实验内容1计数器的设计1.274160十进制计数器仿真波形图实验内容1计数器的设计1.374160十进制计数器仿真测试表1clkQ[4]Q[3]Q[2]Q[1]RCO00000实验内容2计

4、数器的设计2.1六进制计数器的设计方法—清零法仿真电路第一种：清零法实验内容2计数器的设计2.2六进制计数器的设计方法—清零法仿真图第一种：清零法实验内容2计数器的设计2.3六进制计数器的设计方法—清零法完整下载电路第一种：清零法实验内容2计数器设计2.4清零法六进制计数器测试实验步骤：新建项目或打开项目--*.qpf；新建原理图文件--*.bdf；编译；建仿真波形文件--*.vwf；分配管脚:为输入输出信号分析管脚，编译，生成_*.sof文件，下载。实验内容2计数器的设计2.5清零法六进制计数器测试表2clkQ[3]Q[2]Q[1]Q[0]0000注意：LED灯亮输出记为“0”，否则记

5、“1”实验内容3计数器的设计第二种：置数法3.1六进制计数器的设计方法—置数法仿真电路实验内容2计数器的设计3.2六进制计数器的设计方法—置数法仿真图第二种：置数法实验内容3计数器的设计3.3六进制计数器的设计方法—置数法数码显示完整电路实验内容3计数器的设计3.4置数法六进制计数器测试表2clk数码显示输出实验内容4计数器的设计4.1Verilog语言设计计数器——状态机法设计星期电路利用状态机法设计星期电路，要求显示星期1、2、3、4、5、6及星期日（可用数字8代替）；状态机法：always加case语句，即可实现状态转移图的描述。星期的状态转移图为：1234568实验内容4计数器的

6、设计modulecounter1(week,PR,clk);inputPR,clk;outputweek;reg[3:0]week;reg[3:0]state;parameters1=4'd1,s2=4'd2,s3=4'd3,s4=4'd4,s5=4'd5,s6=4'd6,s8=4'd8;always@(posedgeclk)beginif(~PR)week<=s1;elsebegincase(state)s1:beginstate<=s2;week<=state;ends2:beginstate<=s3;week<=state;ends3:beginstate<=s4;week<=st

7、ate;ends4:beginstate<=s5;week<=state;ends5:beginstate<=s6;week<=state;ends6:beginstate<=s8;week<=state;ends8:beginstate<=s1;week<=state;endendcaseendendendmodule实验内容4计数器的设计3.2状态机法的数码显示完整电路图实验内容4计数器的设计3.3星期计数器测试表3clk数码显