专升本【数字电路和逻辑设计】考试答案解析

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1、[试题分类]:专升本《数字电路与逻辑设计》_08007750[题型]:单选[分数]:21.二进制数-0110的反码是（最高位是符号位）（）A.11010B.00110C.11001D.10110答案:C2.如果状态A与B，C与D分别构成等效对，那么能构成状态等效类的是（）A.ABCB.BCDC.ABD.ABCD答案:C3.移位寄存器74194工作在左移串行输入方式时，S1S0的取值为()A.00B.11C.01D.10答案:D4.三变量构成的逻辑函数的最小项m1和最小项m7一定满足()A.B.C.D.答案:C5.十进制数12.75用二进制表示应为:（）A.1100.

2、01B.1100.11C.1010.10D.1010.011答案:B6.8421BCD码01010001.0101对应的二进制数为()A.100100.01B.101110.01C.110011.10D.110110.10答案:C7.下图为OC门组成的线与电路其输出F为()A.B.0C.1D.答案:C8.要求RS触发器（R、S均为高电平有效）状态由0→1，其输入信号为（）。A.RS=01B.RS=10C.RS=d1D.RS=d0答案:A9.逻辑函数等于（）A.1B.BC.0D.答案:B10.函数，则其反函数()A.B.C.D.答案:D11.JK触发器的J＝K＝1,当

3、触发信号到来时，输出次态Qn+1为:()A.与现态相反B.0C.1D.不变答案:A12.逻辑函数F(A,B,C)=AB＋BC+AC的标准表达式是()A.∑m(0,1,2,4)B.∏m(1,3,5,7)C.∑M(0,2,4,6)D.∑m(3,5,6,7)答案:D13.四个变量可以构成多少个最小项？（）A.15个B.16个C.8个D.4个答案:B14.电源电压为+12V的555集成定时器中放电三极管工作在截止状态，输出端OUT为1时，其TH和TR的输入电压值分别为()A.TH和TR均小于B.TH和TR均大于C.，D.，答案:C15.设计—个1位十进制计数器至少需要多少个

4、触发器？()A.6个B.3个C.10个D.4个答案:D16.T型触发器当时钟脉冲输入时，其输出状态（）A.保持不变B.在T=1时会发生改变C.随时间改变D.等于输入端T的值答案:B17.无符号位的十六进制数减法(A9)l6-(8A)16=（）A.(19)16B.(1F)l6C.(29)16D.(25)16答案:B18.十进制数15用2421BCD码可以表示为（）。A.00011011B.01001000C.00001111D.00010101答案:A19.逻辑函数Y=可化简为:()A.B+ACB.C.D.C+AB答案:A20.LED共阴极七段显示器可由下列哪一个IC

5、来推动七字节较适宜?（）A.74160B.74148C.7448D.7447答案:C[试题分类]:专升本《数字电路与逻辑设计》_08007750[题型]:单选[分数]:21.与非门基本RS触发器的约束方程是()A.B.R+S=1C.D.答案:B2.74153有两个4路数据选择器，每个选择器有多少个输出端？()A.4个B.2个C.8个D.1个答案:D3.实现同—功能的Mealy型同步时序电路比Moore型同步时序电路（）A.状态数目更多B.触发器更多C.触发器—定更少D.状态数目更少答案:D4.CMOS集成电路比TTL集成电路应用得更广泛的主要原因是()A.输出电流大

6、、带负载能力强B.功耗小、集成度高C.价格便宜D.开关速度快答案:A5.TTL集成电路74LS138是3/8线译码器，译码器为输出低电平有效。若地址端输入为A2A1A0=100时，则低电平输出端为（）A.Y6B.Y2C.Y4D.Y1答案:C6.如果全加器的加数A＝1，被加数B=1，低位的进位CI＝0，则全加器的输出和数S及高位的进位CO分别为?()A.S＝0，C0＝0B.S＝0，CO＝1C.S＝1，CO=1D.S=1，CO＝0答案:B7.如果要设计一个奇偶校验产生器，则使用下列哪种集成电路最简单？()A.74LS86异或门B.74LS138译码器C.74LS32或门

7、D.74LS00与非门答案:A8.一般各种PLD组件的输出部分为:()A.非门阵列B.或门阵列C.与门阵列D.与非门阵列答案:B9.555集成定时器电路大致由五部份组成，即电阻分压器、电压比较器、基本R-S触发器、输出驱动器及下列哪一部份?()A.逆向二极管B.充电二极管C.放电三极管D.触发电容答案:C10.组合逻辑电路中的险象是由什么因素引起的？()A.电路中存在时延B.电路未采用最简设计C.电路的输出端过多D.逻辑门类型不同答案:A11.下列几种TTL电路中，输出端可实现线与功能的电路是（）A.与非门B.OC门C.或非门D.异或门答案:B12.逻辑函数Y＝