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时间:2019-05-15
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1、学号分类号本科生毕业论文(设计)题目:基于FPGA的CRC编码器设计院(系)电子与信息工程系专业电子信息工程班级11级电子信息工程2班学生姓名赵鹏指导教师(职称)陈颖(助教)提交时间二〇一五年五月版权声明任何收存和保管本论文各种版本的单位和个人,未经本论文作者同意,不得将本论文转借他人,亦不得随意复制、抄录、拍照或以任何方式传播。否则,引起有碍作者著作权之问题,将可能承担法律责任。原创性声明本人郑重声明:所呈交的学位论文,是本人在导师的指导下,独立进行研究工作所取得的成果。除文中已经注明引用的内容外,本论文不含任何其他个人或集体已经发表或撰写过的作品或成果。对本文的研究做出重要贡献的个
2、人和集体,均已在文中以明确方式标明,本声明的法律结果由本人承担。论文作者签名:日期:年月日摘要基于FPGA的CRC编码器设计作者赵鹏(安康学院电子与信息工程系,陕西安康,725000)摘要数据通信中为了降低通信线路传输的误码率,需要采用高效能的差错控制方法,循环冗余校验CRC(CyclicRedundancyCheck),由于编码简单且有效,抗干扰性能优异,在通信和测控等领域有广泛的应用。是一种最常用的信道编码方法。本文介绍了CRC编码的原理算法。以8bit信息序列为例,并以Altera公司开发的EDA工具QuartusII作为编译、仿真平台,通过Verilog语言来实现CRC编码仿真
3、。楷体GB2312(摘要内容包括:背景(第一段)研究内容、研究方法、研究结果、结论(第二段)摘要关键词:小四黑体安康学院本科生毕业论文(设计)关键词循环冗余校验;信道编码;Verilog语言Abstract空一行DesignofCRCencoderbasedonFPGAZHAOPengTimesNewRomans,小四,姓所有字母大写,名连在一起首字母大写,居中(DepartmentofElectronicandInformationEngineering,AnkangUniversity,Ankang,725000)TimesNewRomans,五号,居中AbstractIndata
4、communicationinordertoreducetheerrorrateofcommunication,needtoadopthighefficienterrorcontrolmethod,cyclicredundancycheckCRC(CyclicRedundancyCheck),becausethecodeissimpleandeffective,anti-jammingperformance,iswidelyappliedinthefieldsofcommunicationandcontrol.Channelcodingisakindofthemostcommonlyu
5、sedmethod.IntroducestheprincipleofCRCalgorithm.Takingasanexample,andtheAlteraEDAdevelopmenttoolQuartusIIasacompiler,simulationplatform,throughtheVeriloglanguagetoachievetheCRCcodesimulation.TimesNewRomans,小四,首行缩进2字符Abstract和KeyWords四号加粗,左齐KeyWordsMonitoringsystem;Smarthouse;Embedded;Boaserver目录目
6、录三号黑体居中加粗章标题宋体小四加粗,节标题宋体五号不加粗第一章绪论................................................................................................................11.1引言..........................................................................................................................................11.2课题
7、研究背景..........................................................................................................................21.2.1国内外研究现状.....................................................................................
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