基础电路设计 rev.1

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1、徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.DOCNO.SHEET1o16基礎電路設計Revision:1報告人:蘇崇民西元2004年9月22日徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:SHEET2of18目錄:一.防盜器原理方塊圖二.電源迴路設計三.輸入介面設計四.輸出介面設計五.CPU介面設計六.高頻接收板基本原理七.發射機基本原理徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:SHEET3of18一.防

2、盜器原理方塊圖(福特防盜器)B+DOMELAMPB+OFF4DOOR11OFFACC.B+ONON.B+143DOORAJARSIREN7B+HOODAJAR820TRUNKAJAR1918B+L.FLASHERR.FLASHERTRUNKBUTTON1612LOCKLOCK15B+UNLOCKMMMM6LINKSW25UNLOCKB+SPEEDTRUNKRELAY10TRUNKMTRANSMITTERRECEIVERMOTOGND11徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:S

3、HEET4of18二.電源迴路設計U1D1R1TNRZ1C1C2C3C41.TNR為突波吸收器,可有效吸收正負SURGE。2.D1可阻隔逆向輸入電壓,避免後端元件因逆向電壓燒毀。3.Z1(27V/1WZener)可將突波吸收器未能完全吸收的SURGE穩壓至27V。4.R1(100Ω,1/2W)為Z1的限流電阻,可避免過大的電流將Z1燒毀。5.C3、C4、C5、C6為穩壓濾波電路,確保5V電源之穩定,不受外在干擾影響。6.建議值:TNR=27V突波吸收器D1=4003R1=100Ω1/2WC1=104PC2=220uF/35VC3

4、=104PC4=220uF/16V徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:SHEET5of18二.輸入介面設計輸入介面大體可分為負觸發(ActiveLow)及正觸發(ActiveHigh)兩種1.負觸發(ActiveLow)V1R1D1R2R3C1C2*C1可消除ESD,須盡量靠近Connector端。*D1可阻隔外部電壓影響到內部介面。*R1為提昇(Pull-Up)電阻,其值不可太大,以避免外部開關入水後產生水電阻時,造成輸入端降為低準位,使得主機誤動作。*R2、R3為分壓電

5、阻,將電池電壓(約12V)降至一般CPU可接受電壓位準。*C2為濾波電容,可濾除開關作動時的彈跳。*建議值:R1=1.3K(1206size)R2=27KR3=47KC1=103P(耐壓100V)C4=102P徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:SHEET6of18何謂水電阻?V1R1D1R2C1R3C2Switch在OPEN狀態時,內部若入水,兩端點間會產生阻抗,阻值約3KΩ。為何Pull-up電阻(R1)的阻值大小會決定主機對水阻抗的耐受能力?V1I1R1I3D1I22

6、7KV2C147KC2徽昌電子股份有限公司WHETRONELECTRONICSCO.,LTD.SORNUMBER:SHEET7of18假設V1=+12VR1=10KΩR1=1.2KΩ開關OPEN,正常狀態V2=V2=[12÷(10K+27K+47K)]×47K[12÷(1.2K+27K+47K)]×47K=6.71V=7.5V開關OPEN,入水狀態V2=2VV2=5.5V(水阻抗約3KΩ)輸入電壓降為2V(Low輸入電壓5.5V(HI準準位),CPU可能會產生位),CPU維持相同邏輯誤判徽昌電子股份有限公司WHETRONELEC

7、TRONICSCO.,LTD.SORNUMBER:SHEET8of182.正觸發(ActiveHigh)D1R2C1R3C2R1*C1可消除ESD,須盡量靠近Connector端。*D1可阻隔外部電壓影響到內部介面。*R1為接地(Pull-Down)電阻,可吸收Surge。*R2、R3為分壓電阻,將輸入電壓(約12V)降至一般CPU可接受電壓位準。*C2為濾波電容,可濾除開關作動時的彈跳。*建議值:R1=5.6K(1206size)R2=27KR3=47KC1=103P(耐壓100V)C4=102P徽昌電子股份有限公司WHETR

8、ONELECTRONICSCO.,LTD.SORNUMBER:SHEET9of18三.輸出介面設計防盜器輸出大體可分為控制馬達、燈泡、Relay等負載1.馬達控制介面V++V++2003MM9V++*可使用電晶體驅動內部Relay,但需在Relay兩端並接一個二

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