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时间:2018-10-28
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1、实验二动态扫描显示电路设计一、设计要求1、设计要求设计一个叫位LED数码显示动态扫描控制电路,显示4位十进制数或4字母的单词,要求显示内容可以通过按键切换。2、硬件环境LP-2900开发装賈的LED数码管为共阴显示器,六个显示器的七个段控制a〜g及小数点dp分别对应相连,各显示器的共阴极分别由一个3线-8线译码器74138的输出Y0〜Y5控制。译码器的3位输入码分别由FPGA的I/O端口DE3、DE2、DE1控制,如图1所示。L27FPGAL34DE3DE2DE18C1C2C3lC4
2、C5OO6OOOC6
3、a〜gdpY1Y2Y3Y4Y53线-8线译码器Y6Y7AMR图1LP-2900开发装置FPGA与LED数码显示器的电路连接3线-8线译码器的3位输入码DE3、DE2、DE1为“000”〜“101”时,输出Y0〜Y5屮有一个为0,FPGA的a〜g端口将控制共阴极为0的数码管显示。比如,当DE3、DE2、DE1为“011”时,¥3=0,数码管C4显示。二、设计原理分析多位七段显示器的控制分为静态和动态扫描两种方法。静态驱动方法是将所有S示器的公共端都接有效电平,各位显示器的段控制信号互不相干,分别控制。这样,
4、n位显示器需要7Xn个控制信号(不包括小数点),即需要FPGA的56个I/O口对其进行控制。动态扫描方法是将所有显示器的各个段控制端(a、b…、g、dp)——对应连接,而各显示器的公共端COM由位扫描信号分别控制。这样,n位显示器只需要8+n个控制信号(包括小数点)。比如,LP-2900开发装罝上B区的6个共阴显示器采用了动态扫描驱动方式,6个共阴端C1〜C6由通过一个3线-8线译码器分时控制,电路原理如图1所示。这样FPGA只需要11个I/O口,其巾8个控制段信号、3个输出二进制码(“000”〜“101
5、”)控制C1〜C6。1.动态显示扫描控制动态扫描驱动电路屮所有的显示器巾相同的段信号控制,公共端有效的显示器将显示相同的字符。所以,要使各显示器显示不同的内容,必须控制它们的公共端分时轮流有效。每个显示器只在其公共端为有效电平时根据段码信号显示相应的字符,公共端无效时灭显。比如,若LP-2900上FPGA端口DE3、DE2、DE1按“000”一“001”一“010”一“011”->“100”-*“101”-*“000”循环输出二进制码,图1中的3线-8线译码器74138将输出顺序脉冲扫描控制6个共阴显示器
6、的公共端C1〜C6,信号波形如阁3所示。每路脉实验二动态扫描显示电路设计一、设计要求1、设计要求设计一个叫位LED数码显示动态扫描控制电路,显示4位十进制数或4字母的单词,要求显示内容可以通过按键切换。2、硬件环境LP-2900开发装賈的LED数码管为共阴显示器,六个显示器的七个段控制a〜g及小数点dp分别对应相连,各显示器的共阴极分别由一个3线-8线译码器74138的输出Y0〜Y5控制。译码器的3位输入码分别由FPGA的I/O端口DE3、DE2、DE1控制,如图1所示。L27FPGAL34DE3DE2D
7、E18C1C2C3lC4
8、C5OO6OOOC6a〜gdpY1Y2Y3Y4Y53线-8线译码器Y6Y7AMR图1LP-2900开发装置FPGA与LED数码显示器的电路连接3线-8线译码器的3位输入码DE3、DE2、DE1为“000”〜“101”时,输出Y0〜Y5屮有一个为0,FPGA的a〜g端口将控制共阴极为0的数码管显示。比如,当DE3、DE2、DE1为“011”时,¥3=0,数码管C4显示。二、设计原理分析多位七段显示器的控制分为静态和动态扫描两种方法。静态驱动方法是将所有S示器的公共端都接有效电平,各
9、位显示器的段控制信号互不相干,分别控制。这样,n位显示器需要7Xn个控制信号(不包括小数点),即需要FPGA的56个I/O口对其进行控制。动态扫描方法是将所有显示器的各个段控制端(a、b…、g、dp)——对应连接,而各显示器的公共端COM由位扫描信号分别控制。这样,n位显示器只需要8+n个控制信号(包括小数点)。比如,LP-2900开发装罝上B区的6个共阴显示器采用了动态扫描驱动方式,6个共阴端C1〜C6由通过一个3线-8线译码器分时控制,电路原理如图1所示。这样FPGA只需要11个I/O口,其巾8个控制
10、段信号、3个输出二进制码(“000”〜“101”)控制C1〜C6。1.动态显示扫描控制动态扫描驱动电路屮所有的显示器巾相同的段信号控制,公共端有效的显示器将显示相同的字符。所以,要使各显示器显示不同的内容,必须控制它们的公共端分时轮流有效。每个显示器只在其公共端为有效电平时根据段码信号显示相应的字符,公共端无效时灭显。比如,若LP-2900上FPGA端口DE3、DE2、DE1按“000”一“001”一“010”一“011”->
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