ram62256随机存储器的应用数电实验报告

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1、ram62256随机存储器的应用数电实验报告说明；引脚锁定编译后下载至FPGA中，在实验系统上硬件验证。完成实验报告。2、电路图3、波形图4、仿真波形输出四、实验结论仿真结果与事实相符篇二：北邮数电上实验报告北京邮电大学数字电路与逻辑设计实验学院：班级：姓名：学号：班内序号：实验一QuartusII原理图输入法设计一、实验目的：(1)熟悉QuartusII原理图输入法进行电路设计和仿真。(2)掌握QuartusII图形模块单元的生成与调(3)熟悉实验板的使用二、实验所用器材：(1)计算机(2)直流稳压电源(3)数字系统与逻辑设计实验开发板三、实验任务要求(1)用逻辑门设

2、计实现一个半加器，仿真验证其功能，并生成新的半加器图形模块单元。(2)用(1)中生成的半加器模块和逻辑门设计实现一个全加器，仿真验证其功能，并下载到实验板测试，要求用拨码开关设定输入信号，发光二极管显示输出信号。(3)用VHDL语言实现全加器。四、实验原理图和实验波形图1、全加器实验原理图。2、全加器实验波形图。五、仿真波形分析由仿真波形可以看出，当a,b,ci有两个或者两个以上为1时，产生进位，即co输出为1，而输出s则是当a,b,ci输入偶数个1时为0，奇数个1时为1，满足实验原理，仿真波形正确。实验三VHDL组合逻辑电路设计一、实验目的：(1)熟悉QuartusI

3、I原理图输入法进行电路设计和仿真。(2)掌握QuartusII图形模块单元的生成与调(3)熟悉实验板的使用二、实验所用器材：(1)计算机(2)直流稳压电源(3)数字系统与逻辑设计实验开发板三、实验任务要求(1)用VHDL语言设计将8421计数器，分频器和数码管译码器连接使用，实现在指定数码管滚动显示0-9，其余数码管不亮，并带有清零功能，并下载到实验板显示计数结果。四、实验VHDL代码和仿真波形图(1)VHDL代码libraryieee;useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entityxia

4、nshiisport(clk,clr:instd_logic;b:outstd_logic_vector(6dop:std_logic_vector(3dop:integerrange0to1249999;signalclktmp:std_logic;signale:std_logic_vector(6dop<=0;elsifclk'eventandclk='1'theniftmp=1249999thentmp<=0;clktmp<=notclktmp;elsetmp<=tmp+1;endif;endif;endproce

5、ssp1;篇三：数字电路实验报告4暨南大学本科实验报告专用纸课程名称数字逻辑电路实验成绩评定实验项目名称中规模集成电路功能测试及应用指导教师实验项目编号0806003804实验项目类型验证型实验地点学生姓名学号学院电气信息学院系专业实验时间2013年6月3日上午～6月3日上午温度℃湿度中规模集成电路功能测试及应用一、实验目的1．熟悉数据选择器和译码器的逻辑功能。2．实现数据选择器和译码器的扩展应用。二、实验器件、设备和仪器1．双4选1数据选择器74LS1531片2．双2:4线译码器74LS1392片3．6反相器74LS041片4．双4输入与非门74LS201片5.数字信

6、号显示仪6．数字万用表UT561台7.TDS－4数字系统综合实验平台芯片引脚图三、实验内容1.验证译码器的逻辑功能（1）静态测试方法测试验证74LS139中一个2:4线译码器的逻辑功能。验证步骤：①G、B、A端信号的接实验台逻辑电平开关，4个译码输出引脚Y0~Y3接逻辑电平指示灯。②G、B、A改变引脚、产生8种组合，观测指示灯的显示状态，自拟表格记录测试结果。③对照74LS139逻辑真值表，验证芯片74LS139=0时，该译码器才能工作，即??为使能端，且低电平有效。当??=1只有??时，信号输出端都是高电平。当芯片使能时，BA输入的编码相应的输出端??????为低电平

7、，其余都是高电平。综上可知，74LS139具有2:4线译码器的逻辑功能（2）动态测试方法测试验证74LS139中一个2:4线译码器的逻辑功能。G，B，A的输入信号直接从可编辑数字波形发生器BCD码中选择，如下所示由上图，可知：=0时，BA输入的编码相应的输出端当????????为低电平，其余都是高电平=1时，信号输出端都是高电平当??2.逻辑部件的扩展将74LS139双2:4线译码器器扩展为3:8线译码器。①画出扩展3:8线译码器逻辑图，连接组装逻辑电路。②测试电路功能。逻辑电路如上所示静态测试：地址控制信号可采用用逻辑电平（即手控），输