电子秒表实验报告.doc

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1、电子技术设计性实训报告学号:姓名:邱富烨同组人:夏文彬班级:03班指导老师:林雪健日期:2012.09.07目录一.实训目的---------------------------------------------------3二.设计功能要求---------------------------------------------3三.电路设计---------------------------------------------------4(一)电路框图--------------------------------

2、------------4(二)单元电路分析-------------------------------------4四.设计总图及其工作原理---------------------------------5(一)工作原理--------------------------------------------5(二)元件清单--------------------------------------------5五.电路调试-------------------------------------------------

3、-6(一)调试过程--------------------------------------------6(二)故障分析与排除-----------------------------------7六.实训心得---------------------------------------------------8一.实验目的1.对芯片74LS160芯片以及555的功能的更形象的认知。2.增强使用EWB软件的能力。3.进一步提高独立分析问题和解决问题的能力。4.掌握数字系统的分析和设计方法。5.对数字集成电路的综合应用有进一

4、步的认识和理解。二.设计题目:制作一个简易的电子秒表功能要求:1具有两位数码显示。分别显示1/10秒和秒计数。2有两个按键分别控制启动(开始计时)/停止和清零。功能表如下:KEY1KEY2功能00清零并停止计时10准备开始计时11启动计时10停止计时概述:要完成题目要求的电子秒表功能,系统应具有如下几部分电路:1.定时电路;题目要求最小计时单位为1/10秒,即100ms。这部分电路必须能准确的产生周期为100ms(频率为10Hz)的时钟信号。2.计时电路:题目要求系统具有两位显示器,分别显示秒和1/10秒信号。所以本系统应具

5、有两个十进制计数器,分别对定时信号进行计数,以产生1/10秒和秒计数。系统计数范围从0.0~9.9秒。3.显示译码驱动电路:将计数器的计数结果(BCD码)通过译码器译成七段显示码并驱动LED数码管显示出来。4.控制电路:根据题目要求,本电子秒表应具有两个按键。其中一个控制秒表的启/停,本按键应有自锁功能,按一次启动计时,再按一次停止计时。另一个按键控制清“0”,本按键不需自锁,按下时系统清“0”;放开时系统回复正常计时功能。系统电路结构框图如图1所示。计数器显示译码器振荡器清“0”启动/停止图1系统结构框图四、电路设计方案:

6、1、定时电路:系统的定时电路要求产生周期为100ms的时钟信号。由于在此实验前我们学过555定时器,故可用时钟信号发生器来实现。定时器是电子秒表的核心,其作用是产生一个标准频率10赫兹的脉冲信号。振荡频率的精度和稳定度决定了秒表的质量(如图2),图3为脉冲信号宽度。100ms时钟信号输出100ms时钟信号发生器图2时钟信号发生器2、计时电路:本电路需要两位十进制加法计数器,对定时电路的时钟信号进行计数。可用两片74LS160实现。74LS160是同步十进制加法计数器,其功能表如下:CPRDLDEPET工作方式X0XXX置零上

7、升沿10XX预置数X1101保持X11X0保持上升沿1111计数应用两片74LS160组合级联可构成10进制计数器。其级联方式可分为串行进位方式和并行进位方式两种。串行进位方式接法如图3所示。图3串行进位方式连接图在串行进位方式中,将高位的74LS160的CP与低位的进位端C相接,当低位计数器计满产生进位时就会给高位计数器一个脉冲,使高位计数器加1。图4、并行进位方式连接图并行进位方式接法如图4所示。它是将高低位计数器的CP接在一起并将低位计数器的进位C与高位计数器的EP接起来。当低位计数器尚未计满时,其进位端C输出低电平使

8、高位计数器处于保持状态(不计数);当低位计数器计满产生进位时,C输出高电平使高位计数器处于计数状态,定时脉冲一到高位计数器加1。同时低位计数器回零,C输出低电平,高位计数器又处于保持状态直到第二个进位脉冲的到来。2、显示译码电路显示译码电路根据显示器件的不同可有不同的器件选择,如74LS4

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