dsp第七章new

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1、第七章定点DSP的软硬件设计§7.1引言§7.2定点DSP的硬件软件§7.3定点DSP系统的BOOT设计§7.4定点DSP的软件设计XCHL《DSP原理及应用》课件1§7.2定点DSP的硬件软件•复位和时钟电路设计–复位电路–时钟电路•存储器接口电路设计–相关引脚–程序存储器扩展–局部数据存储器扩展–全局数据存储器扩展–I/O端口•等待状态发生器XCHL《DSP原理及应用》课件2复位电路Vcc+5V•DSP的六种复位信号•上电复位100KRS•自动复位4.7μF18Vcc27VRSAMAX7066t=−RCln(1−)VWDTcc5一般要求：t≥6TCPUCLKGND

2、自动复位上电复位XCHL《DSP原理及应用》课件3时钟电路•DSP芯片的时钟信号•使用内部振荡电路产生时钟•使用外部时钟源+5VOSCBYPOSCBYP20PXTAL1时钟电路XTAL1/CLKIN20PXTAL2XTAL2XCHL《DSP原理及应用》课件4存储器接口电路设计•DSP芯片内部存储器配置–程序存储器–局部数据存储器–全局数据存储器XCHL《DSP原理及应用》课件5相关引脚•A15~A0：16位双向地址总线A15~A0BR•D15~D0：16位双向数据总线DS•BR；全局数据存储器访问总线请求信号PS•DS：外部数据存储器选通总线IS•IS：I/0空间选通

3、总线D15~D0TMS320C24xx•PS：外部程序存储器选通总线RD•STRB：外部访问有效选通信号WE•R/W：读写信号STRBR/W•RD：读选通信号R/W•WE：写选通信号•R/W：R/W的逆信号XCHL《DSP原理及应用》课件6其它请求控制信号A15~A0BRDS•BOOT：引导装载信号D15~D0•MP/MC：微处理器、微计算机PS•RAMEN：片内单口RAM使能信号IS•READY：外设就绪信号BOOTSTRBMP/MCTMS320C24xxRANENRDREADYWER/WR/WXCHL《DSP原理及应用》课件7程序存储器扩展•程序存储空间构成–微处

4、理器模式MP/MC＝1–微计算机模式MP/MC＝000000000中断外003F中断片003F部用户区内用户区扩4000用户区用户区外部展FDFFFE00DARAMB0扩展DARAMB0FEFFFF00保留保留FFFFFFFF微处理器模式微计算机模式XCHL《DSP原理及应用》课件8用2片8K×8位的EEPROM来扩展8K×16位的程序存储器DSPA12•连线图A0•地址总线•数据总线A0~A12A0~A12•控制信号RSTEEPROM(1)EEPROM(2)D7~D0CERDWED7~D0CERDWED0D7D8D15PSRDWEXCHL《DSP原理及应用》课件90

5、000HMemory-mappedregister局部数据存储器扩展005FH0060HDARAM(B2)007FH32words•局部数据存储空间构成0080HReserved片内除SRAM、00FFH0100HDARAM(B0)DARAM（B0,B1,B2）256/512words02FFHCNF=0可为用户使用外，其余0300HDARAM(B1)地址均为映射寄存器区256/512words04FFH或保留区，地址Reserved0800HSARAM8000h～0ffffh指向片1/2/4/8/16Kwords6FFFH外。7000HPeripheralbus73

6、FFH7400HPeripheralframedatabus743FHdirectconnectUnused8000HExternalFFFFHXCHL《DSP原理及应用》课件10用2片8K×8位的SRAM来扩展8K×16位的片外数据存储器DSP•连线图A12•地址总线A0•数据总线A0~A12A0~A12•控制信号RSTSRAM(1)SRAM(2)D7~D0CERDWED7~D0CERDWED0D7D8D15DSRDWEXCHL《DSP原理及应用》课件11全局数据存储器扩展•寻址范围：0～32K字•地址空间：8000h～0FFFFh•全部需外部扩展•控制信号–BR–

7、WE–RDXCHL《DSP原理及应用》课件12用2片32K×16位的SRAM来扩展32K×16位的片外局部数据存储器和全局数据存储器DSP•连线图A12•地址总线A0•数据总线•控制信号A0~A15A0~A15RSTSRAM(1)SRAM(2)D7~D0CERDWED7~D0CERDWED0D15≥1≥1BR1DSRDWEXCHL《DSP原理及应用》课件13I/O端口•I/O空间配置0000H•数据总线External•地址总线FEFFHFF00HI/Omapped•控制信号registerFFFEH–ISFFFFHWSGR–WE–W/R(RD)XC