78进制计数器课程设计报告

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1、为了适应公司新战略的发展,保障停车场安保新项目的正常、顺利开展,特制定安保从业人员的业务技能及个人素质的培训计划78进制计数器课程设计报告  实验报告  一、实验目的  1.掌握计数器的逻辑功能和应用方法。  2.掌握应用QuartusII软件完成数字系统自动化设计的基本方法与流程。二、实验设备  GW48系列SOPC/EDA实验开发系统实验箱一台计算机一台  三、实验原理  1.设计输入  1)图形输入:原理图输入、状态图输入、波形图输入  2)HDL文本输入:将使用了某种硬件描述语言(HDL)的电路设计文本,如VHDL或Verilog的源程序,进

2、行编辑输入。硬件描述语言硬件描述语言VHDL和VerilogHDL在现在EDA设计中使用最多,也拥有几乎所有的主流EDA工具的支持。VHDL在电子设计领域得到了广泛应用。能将以VHDL语言描述数字系统的程序“翻译”成数字电路结构图文件的软件工具为VHDL综合器。  适配  时序仿真与功能仿真  编程下载目的-通过该培训员工可对保安行业有初步了解,并感受到安保行业的发展的巨大潜力,可提升其的专业水平,并确保其在这个行业的安全感。为了适应公司新战略的发展,保障停车场安保新项目的正常、顺利开展,特制定安保从业人员的业务技能及个人素质的培训计划  (五)硬件

3、测试  四、实验内容  1、在实验系统上实现由74LS161和门电路构成的12进制加法计数器。  2、基于一般模型的十进制计数器设计,CNT10的程序如下:  3、基于LPM的计数器设计。  四、实验结果  1.由74LS161和门电路构成的12进制加法计数器。  .逻辑电路图  .编译结果图  .输入时候的波形仿真图  .运行后的波形仿真图,Timing仿真情况  图3-5Timing波形仿真图  .引脚锁定图  .程序下载  2、基于一般模型的十进制计数器设计  .逻辑电路图  .编译结果图  .输入时候的波形仿真图  .运行后的波形仿真图,Ti

4、ming仿真情况  .引脚锁定图目的-通过该培训员工可对保安行业有初步了解,并感受到安保行业的发展的巨大潜力,可提升其的专业水平,并确保其在这个行业的安全感。为了适应公司新战略的发展,保障停车场安保新项目的正常、顺利开展,特制定安保从业人员的业务技能及个人素质的培训计划  .程序下载  3、基于LPM的计数器设计。  .逻辑电路图  .编译结果图  .输入时候的波形仿真图  数电课程设计报告  班级:自动化101  学号:  姓名:张艳  实验一二进制全加器  一.实验原理  QuartusII软件使用简介  QuartusII是Altera公司提供

5、的FPGACPLD开发集成环境,Altera是世界上最大可编程逻辑器件供应商之一。QuartusII界面友好、使用便捷,被誉为业界最易用易学的EDA软件。其主要功能为数字电子系统的设计输入、编辑、仿真、下载等。该软件支持原理图输入设计和VHDL语言输入设计和原理图与HDL混合输入设计。  该实验就是应用QuartusII采用原理图方式进行设计的流程。  二.实验原理图  仿真目的-通过该培训员工可对保安行业有初步了解,并感受到安保行业的发展的巨大潜力,可提升其的专业水平,并确保其在这个行业的安全感。为了适应公司新战略的发展,保障停车场安保新项目的正

6、常、顺利开展,特制定安保从业人员的业务技能及个人素质的培训计划  实验二十进制加法器  一.实验原理  频率计设计的基本步骤与上节介绍的完全一样,只是需要考虑从哪一个电路模块开始。这里首先设计测频用含使能控制的两位十进制计数器。  二.实验步骤  1计数器电路设计  含有时钟使能的2位十进制计数器电路设计原理如图2.1所示,频率计的核心元件之一是含有时钟使能及进位扩展输出的十进制计数器。为此这里拟用一个双十进制计数74390和其它一些辅助元件来完成。图中74390连接成两个独立的十进制计数器,待测频率信号clk通过一个与门进入74390的第1个计数器

7、的时钟输入端1CLKA,与门的另一端由计数使能信号enb控制:当enb='1'时允许计数;enb='0'时禁止计数。计数器1到4位输出q[3]、q[2]、q[1]和q[0]并成总线表达方式即q[3..0],由图左下角的OUTPUT输出端口向外输出计数值,同时由一个4输入与门和两个反相器构成进位信号进入第2个计数器的时钟输入端2CLKA。第2个计数器的4位计数输出是q[7]、q[6]、q[5]和q[4],总线输出信号是q[7..4]。这两个计数器的总的进位信号,即可用于扩展输出的进位信号由一个6输入与门和两个反相器产生,由cout输出。clr是计数器的

8、清零信号。目的-通过该培训员工可对保安行业有初步了解,并感受到安保行业的发展的巨大潜力,可提升其的专业水平,

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