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《西安交通大学数字电子技术实验剖析》由会员上传分享，免费在线阅读，更多相关内容在教育资源-天天文库。
1、数字电子技术基于FPGA的EDA基础试验实验报告姓名：王子丰班级：电气42班学号：2140401052一、实验目的1.学习使用ISE13.4软件生成一个新工程文件；2.学习使用HDL进行电路设计；3.学会编辑顶层文件和用户约束文件；4.熟悉仿真、综合、实现及FPGA配置等；5.熟悉在Basys2开发板上的简单外围设备的控制。二、实验内容1.组合逻辑电路实验1)第一题源文件：moduleexp1-1(inputa,inputb,inputc,inputd,outputy);assigny=~(a&b
2、c
3、&d);endmodule约束文件：NET"a"LOC="P11";//SW0NET"b"LOC="L3";//SW1NET"c"LOC="K3";//SW2NET"d"LOC="B4";//SW3NET"y"LOC="M5";//LD0仿真文件：moduleexp1-1test;//Inputsrega;regb;regc;regd;//Outputswirey;//InstantiatetheUnitUnderTest(UUT)exp1-1uut(.a(a),.b(b),.c(c),.d(d),.
4、y(y));initialbegin//InitializeInputsa=0;b=0;c=0;d=0;//Wait100nsforglobalresettofinish#100;//Addstimulusherea=0;b=0;c=0;d=1;#100;a=0;b=0;c=1;d=0;#100;a=0;b=0;c=1;d=1;#100;a=0;b=1;c=0;d=0;#100;a=0;b=1;c=0;d=1;#100;a=0;b=1;c=1;d=0;#100;a=0;b=1;c=1;d=1;#100
5、;a=1;b=0;c=0;d=0;#100;endendmodule仿真波形：1)第二题源文件：modulemux41a(inputwirea,inputwireb,inputwirec,inputwired,inputwire[1:0]s,outputwirey);assigny=~s[1]&~s[0]&a
6、~s[1]&s[0]&b
7、s[1]&~s[0]&c
8、s[1]&s[0]&d;Endmodule约束文件：NET"a"LOC="P11";NET"b"LOC="L3";NET"c"LOC="K3"
9、;NET"d"LOC="B4";NET"s[0]"LOC="G3";NET"s[1]"LOC="F3";NET"y"LOC="M5";仿真文件：modulemux41atest;//Inputsrega;regb;regc;regd;reg[1:0]s;//Outputswirey;//InstantiatetheUnitUnderTest(UUT)mux41auut(.a(a),.b(b),.c(c),.d(d),.s(s),.y(y));initialbegin//InitializeInputs
10、a=0;b=0;c=0;d=0;s=0;//Wait100nsforglobalresettofinish#100；//Addstimulusherea<=0;b<=0;c<=1;d<=0;s[0]<=0;s[1]<=1;#100;endendmodule仿真波形：1)第三题源文件：modulex7heg(inputwire[7:0]x,inputwireclk,inputwireclr,outputreg[6:0]a_to_g,outputreg[3:0]an);wire[1:0]s;reg[3:0
11、]digit;reg[19:0]clkdiv;assigns=clkdiv[19:18];always@(*)case(s)0:if(x[3:0]>=4'b1010)digit=x[3:0]-4'b1010;elsedigit=x[3:0];1:if(x[3:0]>=4'b1010)digit=4'b0001;elsedigit=4'b0000;2:if(x[7:4]>=4'b1010)digit=x[7:4]-4'b1010;elsedigit=x[7:4];3:if(x[7:4]>=4'b1010
12、)digit=4'b0001;elsedigit=4'b0000;default:digit=4'b0000;endcasealways@(*)case(digit)0:a_to_g=7'b0000001;1:a_to_g=7'b1001111;2:a_to_g=7'b0010010;3:a_to_g=7'b0000110;4:a_to_g=7'b1001100;5:a_to_g=7'b0100100;6:a_to_g=7'b0100000;7:a_to
