pc104总线引脚定义

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1、PC/104总线是嵌入式PC机所用的总线标准.有两个总线插头.其中Ｐ１有６４个引脚,Ｐ２有４０个引脚共有104个引脚,这也是PC/104名称的由来.PC104有两个版本，8位和16位，分别与PC和PC/AT相对应。PC104PLUS则与PCI总线相对应.  PC/104模块本质上就是尺寸缩小为３．８英寸３．９英寸的ＩＳＡ总线板卡。它的总线与ISA在ＩＥＥＥ-Ｐ９９６中定义基本相同。具有１６位数据宽度，最高工作频率为８ＭＨｚ数据传输速率达到８ＭＢ／ｓ，地址线２４条，可寻访16M字节地址单元。　   所有PC/104总线信号定义和功能

2、与它们在ISA总线相应部分是完全相同的。104根线分为5类：地址线、数据线、控制线、时钟线、电源线。简要介绍如下：　（１）地址线ＳＡ０~ＳＡ１９和ＬＡ１７~ＬＡ２３　 ＳＡ０~ＳＡ１９是可锁存的地址信号,ＬＡ１７~ＬＡ２３是非锁存信号由于没有锁存延迟因而给外设插板提供了一条快捷途径。ＳＡ０~ＳＡ１９加上ＬＡ１７~ＬＡ２３可实现16MB空间寻址（其中ＳＡ１７~ＳＡ１９和ＬＡ１７~ＬＡ１９是重复的）（２）数据线   数据线ＳＤ０~ＳＤ７和ＳＤ８~ＳＤ１５其中ＳＤ０~ＳＤ７位为低8位数据，ＳＤ８~ＳＤ１５为高8位数据　（３）控制线　  

3、  ＡEN：地址允许信号，输出线，高电平有效。ＡEN＝１，表明处于ＤＭＡ控制周期；ＡEN＝０，表示非ＤＭＡ周期。此信号用来在ＤＭＡ期间禁止Ｉ／Ｏ端口的地址译码。　   BALE：允许地址锁存，输出线。这信号由总线控制器８２８８提供，作为ＣＰＵ地址的有效标志。当ＢＡＬＥ为高电平时将ＳＡ０~ＳＡ１９接到系统总线。其下降沿用来锁存ＳＡ０~ＳＡ１９　   IOR：Ｉ／Ｏ读命令，输出线，低电平有效。用来把选中的Ｉ／Ｏ设备的数据读到数据总线上，在ＣＰＵ启动的周期通过地址线选择Ｉ／Ｏ。在ＤＭＡ周期，Ｉ／Ｏ设备由ＤＡＣＫ选择　   IOW：Ｉ／Ｏ

4、写命令，输出线，低电平有效，用来把数据总线上的数据写入被选中的Ｉ／Ｏ端口　   SMEMR和SMEMW：存储器读／写命令，低电平有效，用于对ＳＡ０~ＳＡ１９这２０位地址寻址的１ＭＢ内存的读／写操作　   MEMR和MEMW：低电平有效，存储器读／写命令，用于对２４位地址线全部存储空间读／写操作　   MEMCS16和I/OCS16：它们是存储器１６位片选信号和Ｉ／Ｏ１６位片选信号，分别指明当前数据传送是１６位存储器周期和１６位Ｉ／Ｏ周期　   SBHE：总线高字节允许信号，该信号有效时表示数据总线上传，送的是高位字节数据　  ＩＲ

5、Ｑ３~ＩＲＱ７,ＩＲＱ９,ＩＲＱ１０~ＩＲＱ１５用于作为来自外部设备的中断请求输入线分别连在主片８２５９Ａ和从片８２５９Ａ中断控制器的输入端。其中ＩＲＱ１３留给数据协处理器使用，不在总线上出现。这些中断请求线都是边沿（上跳边）触发，三态门驱动器驱动。优先级排队是：ＩＲＱ０最高，依次为ＩＲＱ１，ＩＲＱ８~ＩＲＱ１５，然后是ＩＲＱ３~ＩＲＱ７　ＤＲＱ０~ＤＲＱ３和ＤＲＱ５~ＤＲＱ７来自外部设备的ＤＭＡ请求输入线高电平有效，分别连在主片８２３７Ａ和从片８２３７Ａ。ＤＭＡ控制器输入端ＤＲＱ０优先级最高，ＤＲＱ７最低，ＤＲＱ４用于级联，在总

6、线上不出现　DACK0~DACK3和DACK5~DACK7：ＤＭＡ回答信号，低电平有效。有效时表示ＤＭＡ请求，被接受ＤＭＡ控制器占用总线，进入ＤＭＡ周期　  Ｔ／Ｃ：ＤＭＡ终末／记数结束输出线该信号是一个正脉冲表明ＤＭＡ传送的数据已达到其程序预置的字节数，用来结束一次ＤＭＡ数据块传送　   MASTER：输出信号，低电平有效，它由要求占用总线的有主控能力的外设卡驱动，并与ＤＲＱ一起使用，外设的ＤＲＱ得到确认ＤＡＣＫ有效后才使ＭＡＳＴＥＲ有效，从此该设备保持对总线的控制直到MASTER无效　   RESERDRV:系统复位信号，输出

7、线，高电平有效，此信号在系统电源接通时为高电平，当所有电平都达到规定以后变低，即上电复位时有效，用它来复位和初始化接口和Ｉ／Ｏ设备　   IOCHCHK：Ｉ／Ｏ通道检查，输出线，低电平有效，当它变为低电平时，表明接口插件的Ｉ／Ｏ通道出现了错误，它将产生一次不可屏蔽中断　   Ｉ／Ｏ　ＣＨＤＲＹ：Ｉ／Ｏ通道就绪，输入线，高电平表示就绪。该信号线可供低速Ｉ／Ｏ设备或存储器请求延长总线周期之用。当低速设备在被选中，且收到读或写命令时将此线电平拉低，表示未就绪以便在总线周期中加入等待状态。ＴＷ但最多不能超过１０个时钟周期　   REFRE

8、SH：刷新信号为了防止在内存刷新周期内产生不必要的中断。ＩＳＡ提供该刷新信号防止中断发生　   KEY：钥匙位　   ENDXFR：零等待状态信号，输入线，该信号为高电平时，无需插入等待周期　   SYSCLK：系统时钟　   OSC：主振信号输出