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时间:2020-01-26
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1、第5章QuartusII应用初步5.1基本设计流程5.1.1建立工作库文件夹和编辑设计文件5.1基本设计流程5.1.2创建工程⑴打开并建立新工程管理窗口。5.1基本设计流程5.1.2创建工程⑵将设计文件加入工程中。5.1基本设计流程⑶选择目标芯片。5.1基本设计流程5.1.2创建工程⑷工具设置。⑸结束设置。5.1基本设计流程5.1.3编译前设置⑴选择FPGA目标芯片。⑵选择配置器件的工作方式。5.1.3编译前设置5.1基本设计流程5.1.3编译前设置⑶选择配置器件和编程方式。⑷选择目标器件引脚端口状态。⑸选择确认Veriolg语言版本。5.1基本设计流程5.1.4
2、全程编译5.1基本设计流程5.1.5时序仿真⑴打开波形编辑器。5.1基本设计流程5.1.5时序仿真⑵设置仿真时间区域。⑶波形文件存盘。5.1基本设计流程5.1.5时序仿真⑷将工程CNT10的端口信号节点选入波形编辑器中。5.1基本设计流程5.1.5时序仿真⑷将工程CNT10的端口信号节点选入波形编辑器中。5.1基本设计流程5.1.5时序仿真⑸编辑输入波形(输入激励信号)。5.1基本设计流程5.1.5时序仿真⑹总线数据格式设置和参数设置。5.1基本设计流程5.1.5时序仿真⑹总线数据格式设置和参数设置。5.1基本设计流程5.1.5时序仿真⑹总线数据格式设置和参数设置
3、。5.1基本设计流程5.1.5时序仿真⑺仿真器参数设置。5.1基本设计流程5.1.5时序仿真⑻启动仿真器。⑼观察仿真结果。5.1基本设计流程5.1.6应用RTL电路图观察器5.2引脚设置与硬件验证5.2.1引脚锁定5.2引脚设置与硬件验证5.2.1引脚锁定5.2引脚设置与硬件验证5.2.1引脚锁定5.2引脚设置与硬件验证5.2.1引脚锁定5.2引脚设置与硬件验证5.2.1引脚锁定5.2引脚设置与硬件验证5.2.2编译文件下载(1)打开编程窗和配置文件。5.2引脚设置与硬件验证5.2.2编译文件下载(2)设置编程器。5.2引脚设置与硬件验证5.2.2编译文件下载(3
4、)硬件测试。5.2.3AS模式编程5.2引脚设置与硬件验证5.2.4JTAG间接模式编程配置器件1.将SOF文件转化为JTAG间接配置文件。5.2引脚设置与硬件验证5.2.4JTAG间接模式编程配置器件1.将SOF文件转化为JTAG间接配置文件。5.2引脚设置与硬件验证5.2.4JTAG间接模式编程配置器件1.将SOF文件转化为JTAG间接配置文件。5.2引脚设置与硬件验证5.2.4JTAG间接模式编程配置器件2.下载JTAG间接配置文件。5.2.5USB-Blaster编程配置器件使用方法5.2引脚设置与硬件验证5.2.6其他的锁定引脚方法5.2引脚设置与硬件验
5、证5.2.6其他的锁定引脚方法5.2引脚设置与硬件验证5.2.6其他的锁定引脚方法5.3嵌入式逻辑分析仪使用方法1.打开SignalTap II编辑窗口5.3嵌入式逻辑分析仪使用方法2.调入待测信号5.3嵌入式逻辑分析仪使用方法3.SignalTapII参数设置5.3嵌入式逻辑分析仪使用方法4.文件存盘5.3嵌入式逻辑分析仪使用方法5.编译下载5.3嵌入式逻辑分析仪使用方法6.启动SignalTap II进行采样与分析5.3嵌入式逻辑分析仪使用方法6.启动SignalTap II进行采样与分析7.SignalTapII的其他设置和控制方法5.4编辑SignalTa
6、pII的触发信号5.4编辑SignalTapII的触发信号5.4编辑SignalTapII的触发信号5.5原理图输入设计方法5.5.1层次化设计流程1.为本项工程设计建立文件夹2.建立原理图文件工程和仿真5.5原理图输入设计方法5.5.1层次化设计流程2.建立原理图文件工程和仿真5.5原理图输入设计方法5.5.1层次化设计流程3.将设计项目设置成可调用的元件5.5原理图输入设计方法5.5.1层次化设计流程4.设计全加器顶层文件5.5原理图输入设计方法5.5.1层次化设计流程4.设计全加器顶层文件5.5原理图输入设计方法5.5.1层次化设计流程4.设计全加器顶层文件
7、5.5原理图输入设计方法5.5.1层次化设计流程5.将设计项目进行时序仿真5.5原理图输入设计方法5.5.2应用宏模块的多层次原理图设计1.计数器设计5.5原理图输入设计方法5.5.2应用宏模块的多层次原理图设计1.计数器设计5.5原理图输入设计方法2.频率计主结构电路设计5.5原理图输入设计方法5.5.2应用宏模块的多层次原理图设计2.频率计主结构电路设计3.时序控制电路设计4.顶层电路设计5.5原理图输入设计方法5.5.2应用宏模块的多层次原理图设计4.顶层电路设计5.5原理图输入设计方法5.5.374系列宏模块逻辑功能真值表查询习题5-1归纳利用Quartu
8、sII进行
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