2、k的下降沿。A.clock’EVENT B.clock’EVENT AND clock=’1’ C.clock=’0’ D.clock’EVENT AND clock=’0’1.一个项目的输入输出端口是定义在A。A.实体中B.结构体中C.任何位置D.进程体2.描述项目具有逻辑功能的是B。A.实体B.结构体C.配置D.进程3.关键字ARCHITECTURE定义的是A。A.结构体B.进程C.实体D.配置4.MAXPLUSII中编译VHDL源程序时要求C。A.文件名和实体可不同名B.文件名和实体名无关C.文件名和实体名要相同D.不确定5.1987标准的VHDL语言